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东方电子股份有限公司宋瑞获国家专利权

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龙图腾网获悉东方电子股份有限公司申请的专利自适应过程层数据动态检测识别方法获国家发明授权专利权,本发明授权专利权由国家知识产权局授予,授权公告号为:CN119030605B

龙图腾网通过国家知识产权局官网在2025-05-16发布的发明授权授权公告中获悉:该发明授权的专利申请号/专利号为:202411119352.9,技术领域涉及:H04B10/079;该发明授权自适应过程层数据动态检测识别方法是由宋瑞;徐宏;苏彦兴;杨鹏;王志华;秦妙华;罗忠洁;周南;于海宁;任军;王心羽;王猛;王能宜;李慕轩;王建功;曲芳娇设计研发完成,并于2024-08-15向国家知识产权局提交的专利申请。

自适应过程层数据动态检测识别方法在说明书摘要公布了:本发明涉及数字信息传输技术领域,尤其涉及一种自适应过程层数据动态检测识别方法,包括以下步骤:S1首先针对待测装置生成配置文件;S2根据待测装置的需求分为SV发送、GOOSE发送和GOOSE接收,按照不同的需求分为不同的处理方式。该方明具有成本低、光口数量充足、接口与工装匹配方便、自动化程度高等技术效果。

本发明授权自适应过程层数据动态检测识别方法在权利要求书中公布了:1.一种自适应过程层数据动态检测识别方法,其特征在于,包括以下步骤:(S1)将待测装置与自适应过程层数据动态监测识别系统中的采集执行单元模块通过虚端子连接,生成待测装置和采集执行单元模块的ccd配置文件,将该配置文件导入工装配置工具模块,工装配置工具模块确认测试需要的确定配置信息,并生成xml配置文件;(S2)自动测试开始时,将步骤(S1)生成的xml配置文件导入自适应过程层数据动态检测识别系统,采集执行单元模块的CPU解析工装配置工具模块传来的xml配置文件,并按状态序列存储各个数据集信息;根据待测装置的需求分为SV发送、GOOSE发送和GOOSE接收;若待测装置的需求为SV发送,则跳转步骤(S3);若待测装置的需求为GOOSE发送,则跳转步骤(S4);若待测装置的需求为GOOSE接收,则跳转步骤(S5);(S3)在SV发送功能上,采集执行单元模块的FPGA模块分配两块内存,分别定义FPGA内存A和FPGA内存B,用来存储两个SV状态序列的控制块信息,采集执行单元模块的CPU初始时向FPGA模块发送两个状态序列的内容以及定时触发的使能标志和定时触发时间,定时触发功能只针对状态序列1;FPGA模块根据CPU发送的数据集中的波形幅值、频率、相位形成正弦波,组成带品质的SV报文,同时根据幅值的初值和终值来判断是否需要依据步长和步长时间完成电量数据的递变,然后根据定时触发时间从特定网口输出SV报文,经过状态持续时间后,输出下一个状态序列的SV报文,当持续时间为0时,则保持当前状态;若状态序列数量为两个以上,则当FPGA处理完第二个序列后,会向CPU发送一个CAN网中断,CPU接收到中断,便会向FPGA内存A发送状态序列3的配置信息,当FPGA控制发送完状态序列3的内容,便会继续向CPU发送CAN网中断,CPU便会向FPGA内存B发送状态序列4的配置信息,以此类推,直到状态持续在最后一个状态序列;工装配置工具模块会实时检索待测装置相关SV接收异常信息,以及采集执行单元模块发出的SV报文数字量引起的待测装置一系列动作情况,并记录,从而检测待测装置相关功能是否正常;(S4)在GOOSE发送功能上,采集执行单元模块的FPGA模块分配一块内存,定义为FPGA内存C,用来存储GOOSE发送状态序列的控制信息,当状态序列中遥信、遥测信息发生变位时,CPU会根据CCD文件中控制块信息以及变位情况进行GOOSE报文组包,同时会向FPGA发送当前状态序列的GOOSE发送目的MAC地址、网卡输出配置以及状态持续时间,FPGA会根据CPU发来的配置从特定的网卡输出上述GOOSE报文,当状态持续时间为0时,保持在当前序列,若不为0,则通过CAN网中断向CPU继续召唤新的状态序列内容,进行GOOSE报文发送功能,直到状态持续在最后一个状态序列;同时,工装配置工具模块会实时检索待测装置的GOOSE接收异常情况,以及采集执行单元模块发出的GOOSE报文中一系列遥信、遥测内容变化导致的待测装置一系列动作情况,并记录,从而检测待测装置相关功能是否正常;(S5)在GOOSE接收功能上,采集执行单元模块的FPGA模块分配一块内存,定义为FPGA内存D,用来存储GOOSE接收相关信息,CPU通过CCD文件确定需要接收的数据集信息,CPU向FPGA发送第一个数据集的目的MAC地址、APPID以及接收端口信息,来接收待测装置发送的GOOSE报文,经延时25秒后,检索采集执行单元模块GOOSE接收是否消除断链GOOSE接收异常情况来确定是否接收成功,同时将结果返回工装配置工具模块进行记录,从而检测待测装置相关光口发送GOOSE功能是否正常;然后确定数据集1是否有多个端口进行接收,若是,则CPU向FPGA发送第一个数据集的目的MAC地址、APPID以及第二个接收端口的信息,经延时25秒,判断并记录结果,若不是,则CPU对第二个数据集进行相同的处理,直到所有数据集信息均传输完成。

如需购买、转让、实施、许可或投资类似专利技术,可联系本专利的申请人或专利权人东方电子股份有限公司,其通讯地址为:264000 山东省烟台市芝罘区机场路2号;或者联系龙图腾网官方客服,联系龙图腾网可拨打电话0551-65771310或微信搜索“龙图腾网”。

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