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龙图腾网恭喜创远信科(上海)技术股份有限公司申请的专利应用于信道模拟中实现高精度系数更新处理的方法、装置、处理器及其计算机可读存储介质获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115941067B 。

龙图腾网通过国家知识产权局官网在2025-06-27发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202211589822.9，技术领域涉及：H04B17/00；该发明授权应用于信道模拟中实现高精度系数更新处理的方法、装置、处理器及其计算机可读存储介质是由李添设计研发完成，并于2022-12-12向国家知识产权局提交的专利申请。

本应用于信道模拟中实现高精度系数更新处理的方法、装置、处理器及其计算机可读存储介质在说明书摘要公布了：本发明涉及一种应用于信道模拟中实现高精度系数更新处理的方法，包括以下步骤：上位机通过pcie将一列系数发送到FPGA端，并告知FPGA端处理后的更新时间；生成更新信号update；对更新时间的小数部分进行累加进位；生成进位数integer；生成完整的更新长度Length。本发明还涉及一种用于实现应用于信道模拟中的高精度系数更新处理的装置、处理器及存储介质。采用了本发明的应用于信道模拟中实现高精度系数更新处理的方法、装置、处理器及其计算机可读存储介质，相比于现有技术，具有更高的精确度与准确性，弥补了精确度不够带来的不断增大的误差，FPGA端对接收到的系数更新时间的处理精度能够更小，使得产生的系数更新信号更加精确，后续的系数存取及仿真过程更加准确。

本发明授权应用于信道模拟中实现高精度系数更新处理的方法、装置、处理器及其计算机可读存储介质在权利要求书中公布了：1.一种应用于信道模拟中实现高精度系数更新处理的方法，其特征在于，所述的方法包括以下步骤： 1上位机通过pcie将一列系数发送到FPGA端，并告知FPGA端处理后的更新时间； 2生成更新信号update； 3对更新时间的小数部分进行累加进位； 4生成进位数integer； 5生成完整的更新长度Length； 所述的步骤2具体包括以下步骤： 2.1若运行信号run置高位，则系统有序运行，正常下发系数； 2.2更新计数器count每个时钟周期进行不间断的计数，若暂停信号pause或者运行信号run置低位时，则暂停计数过程； 2.3若更新计数器count的计数与更新长度Length相等时，则更新计数器count被清零，同时产生一个更新信号update，即为脉冲信号； 所述的步骤3具体包括以下步骤： 3.1将更新长度Length的小数部分Length_n作为初始值传输入累加器进行累加，累加器运行的使能en为每隔一段时间产生一次的更新信号update； 3.2对累加器的输出结果out进行打拍操作，将输出结果out打一拍后产生新的数据out_delay； 3.3比较输出结果out与out_delay，若out小于out_delay，则更新长度Length的小数部分Length_n完成了完整的小数累加进位过程，且生成脉冲信号out_done。

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