申请/专利权人:中国电子科技集团公司第五十八研究所
申请日:2019-10-30
公开(公告)日:2020-02-11
公开(公告)号:CN110784214A
主分类号:H03L7/095(20060101)
分类号:H03L7/095(20060101)
优先权:
专利状态码:有效-授权
法律状态:2021.11.30#授权;2020.03.06#实质审查的生效;2020.02.11#公开
摘要:本发明公开一种DLL锁定指示电路及方法,属于集成电路设计技术领域。所述DLL锁定指示电路包括鉴相器模块、电荷泵环路滤波器模块、压控延时线模块和锁定指示模块,其中所述鉴相器模块比对CLKD_0、CLKD_N、CLKD_2N三个输入时钟之间的相位差,并输出脉冲控制信号UP、DN;所述电荷泵环路滤波器模块根据脉冲控制信号UP、DN对控制电压VC进行充放电;所述压控延时线模块通过控制电压VC调节其延时,输出CLKD_1~CLKD_2N共2N个时钟信号;所述锁定指示模块根据2N个时钟信号判定DLL是否锁定,并指示锁定是正确锁定还是谐波锁定。
主权项:1.一种DLL锁定指示电路,用于电路系统中,其特征在于,所述DLL锁定指示电路包括:鉴相器模块,比对CLKD_0、CLKD_N、CLKD_2N三个输入时钟之间的相位差,并输出脉冲控制信号UP、DN;电荷泵环路滤波器模块,根据脉冲控制信号UP、DN对控制电压VC进行充放电;压控延时线模块,通过控制电压VC调节其延时,输出CLKD_1~CLKD_2N共2N个时钟信号;锁定指示模块,根据2N个时钟信号判定DLL是否锁定,并指示锁定是正确锁定还是谐波锁定。
全文数据:
权利要求:
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