申请/专利权人:亚德诺半导体国际无限责任公司
申请日:2019-11-12
公开(公告)日:2020-05-19
公开(公告)号:CN111182305A
主分类号:H04N19/42(20140101)
分类号:H04N19/42(20140101);H04N19/436(20140101);G06T3/40(20060101)
优先权:["20181112 US 16/188,209"]
专利状态码:有效-授权
法律状态:2022.03.01#授权;2020.06.12#实质审查的生效;2020.05.19#公开
摘要:本发明涉及图像缩放。在一个例子中,公开视频处理器,包括:输入缓冲器,用于接收输入图像;限幅器电路,用于将所述输入图像划分为多个N个垂直片段;用于去栅格化的N个并行输入缓冲器;N个并行图像缩放器,其中每个缩放器是被配置为根据图像缩放算法对N个垂直片段之一以栅格形式进行线性缩放的硬件;用于重新栅格化的N个并行输出缓冲器;和输出多路复用器,将缩放后的垂直片段合并为合并后的缩放的输出图像。
主权项:1.视频处理器,包括:输入缓冲器,用于接收输入图像;限幅器电路,用于将所述输入图像划分为多个N个垂直片段;N个并行图像缩放器,其中每个缩放器是被配置为根据图像缩放算法对所述N个垂直片段之一进行逐行缩放的硬件;和输出多路复用器,将缩放后的垂直片段合并为合并后的缩放的输出图像。
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权利要求:
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