申请/专利权人：烽火通信科技股份有限公司;武汉飞思灵微电子技术有限公司

申请日：2019-02-28

公开（公告）日：2020-08-25

公开（公告）号：CN109787703B

主分类号：H04J3/06(20060101)

分类号：H04J3/06(20060101)

优先权：

专利状态码：有效-授权

法律状态：2020.08.25#授权;2019.06.14#实质审查的生效;2019.05.21#公开

摘要：本发明公开了一种时间戳的修正方法、时钟同步方法及系统，涉及通信技术领域。时间戳的修正方法包括：记录物理层通道接收的数据帧帧头的时间戳以及相邻帧头之间的时钟信息，时钟信息为时长或者时钟周期数量；如果当前的时钟信息偏离前N个时钟信息的平均值，将当前数据帧帧头的时间戳向偏离的相反方向偏移，得到修正的时间戳，其中，N1，且偏移的时间量是对多个时钟信息进行统计得到的。本发明可以提高时间戳的精度。

主权项：1.一种时钟同步方法，其特征在于，其包括：第一处理器的多个物理层通道发携带同步信息的数据帧，并记录数据帧帧头的时间戳和相邻帧头之间的时钟信息；第二处理器使用时间戳的修正方法对所述数据帧帧头的时间戳进行修正，得到修正的时间戳；基于从第一处理器接收的同步信息生成响应信息；根据所述修正的时间戳和所述同步信息及其响应信息进行时钟调整；所述时间戳的修正方法包括：记录物理层通道接收的数据帧帧头的时间戳以及相邻帧头之间的时钟信息，时钟信息为时长或者时钟周期数量；如果当前的时钟信息偏离前N个时钟信息的平均值，将当前数据帧帧头的时间戳向偏离的相反方向偏移，得到修正的时间戳，其中，N1，且偏移的时间量是对多个时钟信息进行统计得到的。

全文数据：一种时间戳的修正方法、时钟同步方法及系统技术领域本发明涉及通信技术领域，具体是涉及一种时间戳的修正方法、时钟同步方法及系统。背景技术电信运营商在2020年实现5G商用需求强烈，为了满足5G在带宽、监测和时钟同步等方面的新要求，光互联网论坛OpticalInternetForum，OIF、国际电信联盟InternationalTelecommunicationUnion，ITU等国际电信组织于2016年底先后发布了灵活以太网FlexibleEthernet，FlexE、灵活光传送网FlexibleOpticalTransportNetwork，FlexO、光传输单元OpticalTransportUnit，OTU等用于5G承载网络的超100G传输标准。目前，这些国际标准都定义了用于承载IEEE1588协议的物理层通道PhysicalLayer，PHY，其中，IEEE1588协议是一种精确时间协议PrecisionTimeProtocal，PTP，基于PTP报文以及时间戳对时钟的频率和相位进行调整，进而实现不同设备之间的时钟同步。但是，各物理层通道上数据帧的传输、对齐码字AlignmentMarker，AM的插入与删除、以及跨时钟域等因素会引起帧头抖动。例如，发送端在FlexE的物理层通道中插入或删除AM码字的周期与FlexE的帧周期不是整数倍关系，导致接收端FlexE帧的帧头存在±12ns的抖动，严重影响时钟同步精度。发明内容针对现有技术中存在的缺陷，本发明实施例的目的在于提供一种时间戳的修正方法、时钟同步方法及系统，可以提高时间戳的精度。第一方面，本发明实施例提供一种时间戳的修正方法，其包括：记录物理层通道接收的数据帧帧头的时间戳以及相邻帧头之间的时钟信息，时钟信息为时长或者时钟周期数量；如果当前的时钟信息偏离前N个时钟信息的平均值，将当前数据帧帧头的时间戳向偏离的相反方向偏移，得到修正的时间戳，其中，N1，且偏移的时间量是对多个时钟信息进行统计得到的。结合第一方面，在第一种可选的实现方式中，所述方法还包括：所述当前的时钟信息与前N个时钟信息的平均值的差值超出阈值范围时，将所述前N个时钟信息均设置为初始平均值。结合第一方面，在第二种可选的实现方式中，所述前N个时钟信息按照记录顺序存储在预先创建的队列中。结合第一方面，在第三种可选的实现方式中，所述时长为相邻帧头的所述时间戳之差；或者，所述时长＝所述时钟周期数量×时钟周期。第二方面，本发明实施例提供一种时钟同步方法，其包括：第一处理器的多个物理层通道收发携带同步信息及其响应信息的数据帧，并记录数据帧帧头的时间戳和相邻帧头之间的时钟信息；第二处理器使用如第一方面所述的时间戳的修正方法对所述数据帧帧头的时间戳进行修正，得到修正的时间戳；生成所述响应信息；根据所述修正的时间戳和所述同步信息及其响应信息进行时钟调整。结合第二方面，在第一种可选的实现方式中，所述第一处理器和所述第二处理器之间通过数据包传输所述同步信息及其响应信息。第三方面，本发明实施例提供一种时间戳的修正系统，其包括：检测模块，其用于记录物理层通道接收的数据帧帧头的时间戳以及相邻帧头之间的时钟信息，时钟信息为时长或者时钟周期数量；修正模块，其用于如果当前的时钟信息偏离前N个时钟信息的平均值，将当前数据帧帧头的时间戳向偏离的相反方向偏移，得到修正的时间戳，其中，N1，且偏移的时间量是对多个时钟信息进行统计得到的。结合第三方面，在第一种可选的实现方式中，所述修正模块还用于所述当前的时钟信息与前N个时钟信息的平均值的差值超出阈值范围时，将所述前N个时钟信息均设置为初始平均值。结合第三方面，在第二种可选的实现方式中，所述前N个时钟信息按照记录顺序存储在预先创建的队列中。结合第三方面，在第三种可选的实现方式中，所述时长为相邻帧头的所述时间戳之差；或者，所述时长＝所述时钟周期数量×时钟周期。第四方面，本发明实施例提供一种时钟同步系统，所述系统包括第一处理器和第二处理器，第一处理器的多个物理层通道收发携带同步信息及其响应信息的数据帧；所述第一处理器用于记录所述数据帧帧头的时间戳以及相邻帧头之间的时钟信息；所述第二处理器用于使用如第一方面所述的时间戳的修正方法对所述数据帧帧头的时间戳进行修正，得到修正的时间戳；还用于生成所述响应信息；以及根据所述修正的时间戳和所述同步信息及其响应信息进行时钟调整。结合第四方面，在第一种可选的实现方式中，所述第一处理器和所述第二处理器之间通过数据包传输所述同步信息及其响应信息。与现有技术相比，本发明实施例提供时间戳的修正方法，记录物理层通道接收的数据帧帧头的时间戳以及相邻帧头之间的时钟信息，时钟信息为时长或者时钟周期数量；如果当前的时钟信息偏离前N个时钟信息的平均值，将当前数据帧帧头的时间戳向偏离的相反方向偏移，得到修正的时间戳，其中，N1，且偏移的时间量是对多个时钟信息进行统计得到的。通过本发明实施例时间戳的修正方法，可以提高时间戳的精度。附图说明为了更清楚地说明本发明实施例中的技术方案，下面将对实施例描述中所需要使用的附图作简单地介绍，显而易见地，下面描述中的附图仅仅是本发明的一些实施例，对于本领域技术人员来讲，在不付出创造性劳动的前提下，还可以根据这些附图获得其他的附图。图1是本发明实施例时间戳的修正方法流程图；图2是本发明实施例时间戳的修正系统示意图；图3是本发明实施例时钟同步方法流程图；图4是本发明实施例时钟同步系统示意图；图5是以太网数据包的帧结构示意图，其中，图5A是开销数据包的帧结构示意图，图5B是PTP报文发送指示数据包的帧结构示意图，图5C是响应报文的以太网数据包的帧结构示意图；图6是本发明实施例时钟同步方法中，提取PTP报文的流程图；图7是本发明实施例时钟同步方法中，插入PTP报文的流程图。具体实施方式下面将结合本发明实施例中的附图，对本发明实施例中的技术方案进行清楚、完整地描述，显然，所描述的实施例仅仅是本发明一部分实施例，而不是全部的实施例。基于本发明中的实施例，本领域技术人员在没有作出创造性劳动前提下所获得的所有其他实施例，都属于本发明保护的范围。下面结合附图及具体实施例对本发明作进一步的详细描述。参见图1所示，本发明实施例提供一种时间戳的修正方法，时间戳的修正方法包括：S110记录物理层通道接收的数据帧帧头的时间戳以及相邻帧头之间的时钟周期数量。具体的，当前的时钟周期数量之前的N个时钟周期数量按照记录顺序存储在预先创建的队列中，其中，N1，N为正整数。S120计算前N个时钟周期数量的平均值，前N个时钟周期数量的平均值为Mave。S130判断当前的时钟周期数量是否偏离平均值，若是，进入步骤S140；若否，进入步骤S150。具体的，当前的时钟周期数量为当前数据帧与前一个数据帧的帧头之间的时钟周期数量，即MN+1，当前的时钟周期数量即记录的第N+1个时钟周期数量，前N个时钟周期数量的平均值即预计的第N+1个时钟周期数量。S140将当前数据帧帧头的时间戳向偏离的相反方向偏移，得到修正的时间戳，作为当前数据帧帧头的时间戳。例如，当前数据帧帧头的时间戳为tN+1，当MN+1Mave时，修正的时间戳tc_N+1＝tN+1-Δt，Δt为偏移的时间量。当MN+11，当前的时钟周期数量为当前数据帧与前一个数据帧的帧头之间的时钟周期数量。步骤S220与步骤S120相同，此处不再赘述。S230判断当前的时钟周期数量与平均值之差是否超出阈值范围，若是，返回步骤S200；若否，进入步骤S240。如果当前的时钟周期数量偏离前N个时钟周期数量的平均值超出阈值范围时，将前N个时钟周期数量均设置为初始平均值，可以避免数据帧的接收端故障对时间戳的影响。S240判断当前的时钟周期数量是否偏离平均值，若是，进入步骤S250；若否，进入步骤S260。步骤S240与步骤S130相同，此处不再赘述。S250将当前数据帧帧头的时间戳向偏离的相反方向偏移，得到修正的时间戳，并作为当前数据帧帧头的时间戳。步骤S250与步骤S140相同，此处不再赘述。S260保存当前数据帧帧头的时间戳，并移除队列头部的数据，将当前的时钟周期数量加入队列尾部。步骤S260与步骤S150相同，此处不再赘述。在其他的实施方式中，时长为相邻帧头的时间戳之差；或者，时长＝时钟周期数量×时钟周期。本实施例提供时间戳的修正方法，记录物理层通道接收的数据帧帧头的时间戳以及相邻帧头之间的时钟信息，时钟信息为时长或者时钟周期数量；如果当前的时钟信息偏离前N个时钟信息的平均值，将当前数据帧帧头的时间戳向偏离的相反方向偏移，得到修正的时间戳，其中，N1，且偏移的时间量是对多个时钟信息进行统计得到的。如果当前的时钟信息等于前N个时钟信息的平均值，则当前数据帧帧头的时间戳无需进行修正。通过本实施例时间戳的修正方法，对帧头进行平滑处理，可以提高时间戳的精度。参见图2所示，本发明实施例还提供一种时间戳的修正系统，用于实现前述实施例的时间戳的修正方法，时间戳的修正系统包括检测模块110a和修正模块210a。检测模块110a用于记录物理层通道接收的数据帧帧头的时间戳以及相邻帧头之间的时钟信息，时钟信息为时长或者时钟周期数量。具体的，时长为相邻帧头的时间戳之差；或者，时长＝时钟周期数量×时钟周期。前N个时钟信息按照记录顺序存储在预先创建的队列中。修正模块210a用于如果当前的时钟信息偏离前N个时钟信息的平均值，将当前数据帧帧头的时间戳向偏离的相反方向偏移，得到修正的时间戳，其中，N1，且偏移的时间量是对多个时钟信息进行统计得到的。具体的，修正模块210a还用于当当前的时钟信息偏离前N个时钟信息的平均值超出阈值范围时，将前N个时钟信息均设置为初始平均值，阈值范围和初始平均值是对多个时钟信息进行统计得到的。参见图3所示，本发明实施例还提供一种时钟同步方法，时钟同步方法包括：S310第一处理器的多个物理层通道接收携带同步信息的数据帧，并记录数据帧帧头的时间戳和相邻帧头之间的时钟信息。S320第二处理器使用前述实施例的时间戳的修正方法对数据帧帧头的时间戳进行修正，得到修正的时间戳。经过修正处理的数据帧帧头的时间戳作为数据帧帧头的时间戳。S330第二处理器生成响应信息并发送给第一处理器。S340第一处理器将响应信息插入数据帧并向外发送。S350第二处理器根据修正的时间戳和同步信息及其响应信息进行时钟调整。步骤S330和S340与步骤S350可以同时进行，也可以先后进行，不作限定。进一步的，第一处理器和第二处理器之间通过数据包传输同步信息及其响应信息。第一处理器和第二处理器均可以是独立的集成电路芯片，例如，数字信号处理器DigitalSignalProcessing，DSP、专用集成电路ApplicationSpecificIntegratedCircuit，ASIC、现成可编程门阵列Field-ProgrammableGateArray，FPGA或者其他可编程逻辑器件、分立门或者晶体管逻辑器件、分立硬件组件等。第一处理器和第二处理器之间通过串行千兆媒体独立SerialGigabitMediaIndependentInterface，SGMII接口传输携带同步信息及其响应信息的数据包。第一处理器和第二处理器也可以集成在同一个集成电路芯片内。具体的，第一处理器从每物理层通道接收的数据帧帧头提取同步信息或者包含同步信息的开销并缓存到设定数量后，生成组包请求，并根据待发送的数据帧帧头生成同步发送指示。第一处理器根据同步发送指示和组包请求将缓存的数据封装成数据包后，通过SGMII接口发送给第二处理器。具体的，第一处理器根据第i个物理层通道待发送的数据帧的开销复帧指示信息生成同步发送指示，采用加权轮循调度算法对n个同步发送指示进行调度，1≤i≤n。同时，第一处理器采用加权轮循调度算法对n个组包请求进行调度。第二处理器从收到的数据包中解析出同步信息，并向第一处理器发送携带响应信息的数据包。具体的，第二处理器根据同步发送指示和响应信息的发送频率，对响应信息进行封装得到数据包，并通过SGMII接口传输到第一处理器。第一处理器从数据包中提取响应信息，并根据同步发送指示将响应信息插入到待发送的数据帧中。具体的，同步信息可以是精确时间协议PTP报文，不作限定。根据IEEE1588协议，PTP报文包括同步报文Sync、跟随报文Follow_up、延迟请求报文Delay_Req和延迟应答报文Delay_Resp。主时钟定期发送同步报文Sync，如果为两步模式，则会随后发送跟随报文Follow_Up，并在跟随报文Follow_Up报文中通告同步报文Sync的实际发送时间T1。如果为单步模式，则在发送的同步报文Sync中即包含了报文实际发送时间T1，然后从时钟记录同步报文Sync的到达时间T2，从时钟在T3时刻发送时延请求报文Delay_Req，主时钟记录时延请求报文Delay_Req到达时间T4，并将时间T4通过延迟应答报文Delay_Resp发送给从时钟。在本实施例中，同步信息可以是同步报文Sync，则响应信息是时延请求报文Delay_Req；或者，同步信息可以是时延请求报文Delay_Req，则响应信息是延迟应答报文Delay_Resp。为了便于说明，同步信息和响应信息分别为PTP报文和响应的PTP报文。本发明实施例在5G承载网络进行时钟同步时，1接收PTP报文后，第一处理器对开销中的信息进行统一封装，开销中的信息包括PTP报文，同时，记录数据帧帧头的时间戳和相邻帧头之间的时钟信息，将封装的开销、时间戳和时钟信息发送至第二处理器。第二处理器解析出PTP报文，对PTP报文的时间戳进行修正处理，完成时钟频率和相位调整功能。2向外发送作为响应的PTP报文，将响应的PTP报文进行统一封装，发送给第一处理器，第一处理器根据复帧字段信息和PTP报文发送频率插入到开销中，随数据帧向外发送。通过本实施例时间戳的修正方法，对帧头进行均衡化处理，可以提高时间戳的精度，有效抑制AM码字或者FlexO和OTU中跨时钟域等因素对帧头抖动的影响，极大地提高了时钟同步精度，同步精度可达±4ns，满足FlexE、FlexO和OTU等5G承载网络的需求。另外，本发明实施例根据同步发送指示发送PTP报文，在PTP报文传送间隔传送其他的报文信息，极大提高开销的带宽利用率；可以精确地控制PTP报文发送频率，同时不会引起数据流中的带宽抖动。可以灵活配置PTP报文，即便将来定义新的标准，也可以通过修改第二处理器进行扩展，有效提高芯片适用性，降低投片风险。参见图4所示，本发明实施例还提供一种时钟同步系统，时钟同步系统包括第一处理器100和第二处理器200，第一处理器100的多个物理层通道收发携带同步信息及其响应信息的数据帧。第一处理器100用于记录数据帧帧头的时间戳以及相邻帧头之间的时钟信息。第二处理器200用于使用前述实施例的时间戳的修正方法对数据帧帧头的时间戳进行修正，得到修正的时间戳；还用于生成响应信息；以及根据修正的时间戳和同步信息及其响应信息进行时钟调整。具体的，第一处理器100和第二处理器200之间通过数据包传输同步信息及其响应信息。参见图4所示，第一处理器100包括接收侧检测模块110b、开销提取模块120、封装模块130、解析模块140、开销插入模块150和帧头生成模块160。第二处理器包括修正模块210b、开销解析模块220、PTP报文解析模块230、时钟调整模块240、PTP报文生成模块250和封装模块260。接收侧检测模块110b用于记录物理层通道接收的数据帧帧头的时间戳以及相邻帧头之间的时钟信息，时钟信息为时长或者时钟周期数量。例如，对于FLEXO帧，多种不同的报文信息可以时分复用开销中的同一个物理层通道。接收侧检测模块110b用于从数据帧中检测帧头特征码型得到帧头信息。帧头生成模块160用于根据第i路的发送侧控制信号，从缓存中读取相应的响应报文，并将其插入到数据帧中向外发送。具体的，帧头生成模块160用于生成本地FlexEFlexO帧头和包络信息。开销插入模块150用于根据开销复帧指示信息生成PTP报文发送指示，以及将PTP报文的响应报文插入到开销中。开销提取单元120用于从接收的数据帧中提取并缓存设定数量的开销后，生成组包请求，实现对开销的统一缓存控制。第一处理器的封装单元130用于根据组包请求和PTP报文发送指示，封装成开销数据包后通过SGMII接口发送到第二处理器的解析单元。多个端口可以时分复用同一个串行接口。具体的，开销数据包为以太网数据包，开销数据包的帧格式如图5A所示。图5A的帧结构包括前导码、目的地址、源地址、长度、请求复帧号、状态指示、起始复帧号、开销净荷和校验码。源地址为接收的数据帧的PHY的相关信息。状态指示为第一指定标识时，表示该数据包为提取的开销数据包，状态指示为第二指定标识时，表示该数据包为提取的开销数据包和复帧信息，将复帧信息以及缓存达到设定数量的开销数据组装成数据包。第一处理器的封装单元130还用于将PTP报文发送指示组装成PTP报文发送指示数据包，如图5B的以太网数据包，图5B的帧结构包括前导码、目的地址、源地址、长度、请求复帧号、状态指示、填充字节和校验码。第一处理器的解析模块140用于从封装模块260接收数据包，利用数据包中的目的地址和请求复帧信息等字段对响应的PTP报文进行解析。开销插入模块150用于采用链式控制方法，对接收到的响应报文进行缓存控制。第二处理器的解析单元220用于从第一处理器的封装单元130接收开销数据包和PTP报文发送指示数据包，并从中分别提取开销和PTP报文发送指示。具体的，第二处理器的解析单元220根据接收到的数据包中的目的地址和请求复帧号提取PTP报文。PTP报文解析模块230用于从开销中提取PTP报文并发送到时钟调整模块240。修正模块210b用于从接收侧检测模块110b接收帧头的时间戳以及相邻帧头之间的时钟信息，如果当前的时钟信息偏离前N个时钟信息的平均值，将当前数据帧帧头的时间戳向偏离的相反方向偏移，得到修正的时间戳并发送到，其中，N1，且偏移的时间量是对多个时钟信息进行统计得到的时钟调整模块。对接收的数据帧帧头进行平滑处理，使得帧头分布均匀，并对时间戳进行修正。具体的，修正模块210b还用于当当前的时钟信息偏离前N个时钟信息的平均值超出阈值范围时，将前N个时钟信息均设置为初始平均值，阈值范围和初始平均值是对多个时钟信息进行统计得到的。时钟调整模块240用于根据PTP报文和数据帧帧头的时间戳进行时钟频率和相位同步，进而实现高精度时钟同步。具体的，根据IEEE1588协议，对本地时钟进行频率和相位的调整。PTP报文生成模块250用于根据PTP报文和时间戳生成响应报文，并进行缓存。第二处理器的封装模块260用于根据PTP报文发送指示以及PTP报文的发送频率，将缓存的响应报文封装为数据包后通过SGMII接口传输到第一处理器的解析模块140。该数据包如图5C所示的以太网数据包，图5C的帧结构包括前导码、目的地址、源地址、长度、请求复帧号、开销净荷和校验码。基于图4所示的时钟同步系统，以FLEXO帧为例，提取PTP报文的过程参见图6所示，包括：S400第一处理器生成PTP报文发送指示，包括：S401第一处理器的开销插入模块150根据数据帧复帧指示生成PTP报文发送指示。S402第一处理器的封装模块130采用加权轮循调度算法调度n路PTP报文发送指示。S410第一处理器的第i路接收侧检测模块110b从数据帧中检测帧头特征码型。S420第一处理器的开销提取模块120提取并缓存特定数量的开销后生成组包请求。S430第一处理器的封装模块130采用加权轮循调度算法调度n路组包请求。S440第一处理器的封装模块130根据组包请求和PTP报文发送指示封装数据包。S450第二处理器的解析模块220对数据包进行解析。S460第二处理器的PTP报文解析模块230解析出PTP报文。S470第二处理器的时钟调整模块240根据PTP报文和时间戳进行时钟频率和相位同步。基于图4所示的时钟同步系统，以FLEXO帧为例，插入PTP报文的过程参见图7所示，包括：S510第二处理器的PTP报文生成模块250根据PTP报文和时间戳生成响应报文，并进行缓存。S520第二处理器的封装模块260根据PTP报文发送至少以及PTP报文的发送频率，将PTP报文封装为数据包后通过SGMII接口传输到第一处理器的解析模块。S530第一处理器的解析模块140根据数据包中的目的地址和请求复帧信息等字段对响应报文进行解析。S540第一处理器的开销插入模块150采用链式控制方法，对接收到的响应报文进行缓存控制。S550帧头生成模块160根据第i路的发送侧控制信号，从缓存中读取相应的响应报文，并将其插入到数据帧中向外发送。本发明不局限于上述实施方式，对于本技术领域的普通技术人员来说，在不脱离本发明原理的前提下，还可以做出若干改进和润饰，这些改进和润饰也视为本发明的保护范围之内。本说明书中未作详细描述的内容属于本领域专业技术人员公知的现有技术。

权利要求：1.一种时间戳的修正方法，其特征在于，其包括：记录物理层通道接收的数据帧帧头的时间戳以及相邻帧头之间的时钟信息，时钟信息为时长或者时钟周期数量；如果当前的时钟信息偏离前N个时钟信息的平均值，将当前数据帧帧头的时间戳向偏离的相反方向偏移，得到修正的时间戳，其中，N1，且偏移的时间量是对多个时钟信息进行统计得到的。2.如权利要求1所述的时间戳的修正方法，其特征在于，所述方法还包括：所述当前的时钟信息与前N个时钟信息的平均值的差值超出阈值范围时，将所述前N个时钟信息均设置为初始平均值。3.如权利要求1所述的时间戳的修正方法，其特征在于：所述前N个时钟信息按照记录顺序存储在预先创建的队列中。4.如权利要求1所述的时间戳的修正方法，其特征在于：所述时长为相邻帧头的所述时间戳之差；或者，所述时长＝所述时钟周期数量×时钟周期。5.一种时钟同步方法，其特征在于，其包括：第一处理器的多个物理层通道收发携带同步信息及其响应信息的数据帧，并记录数据帧帧头的时间戳和相邻帧头之间的时钟信息；第二处理器使用如权利要求1至4任一项所述的时间戳的修正方法对所述数据帧帧头的时间戳进行修正，得到修正的时间戳；生成所述响应信息；根据所述修正的时间戳和所述同步信息及其响应信息进行时钟调整。6.如权利要求5所述的时钟同步方法，其特征在于：所述第一处理器和所述第二处理器之间通过数据包传输所述同步信息及其响应信息。7.一种时间戳的修正系统，其特征在于，其包括：检测模块，其用于记录物理层通道接收的数据帧帧头的时间戳以及相邻帧头之间的时钟信息，时钟信息为时长或者时钟周期数量；修正模块，其用于如果当前的时钟信息偏离前N个时钟信息的平均值，将当前数据帧帧头的时间戳向偏离的相反方向偏移，得到修正的时间戳，其中，N1，且偏移的时间量是对多个时钟信息进行统计得到的。8.如权利要求7所述的时间戳的修正系统，其特征在于：所述修正模块还用于所述当前的时钟信息与前N个时钟信息的平均值的差值超出阈值范围时，将所述前N个时钟信息均设置为初始平均值。9.如权利要求7所述的时间戳的修正系统，其特征在于：所述前N个时钟信息按照记录顺序存储在预先创建的队列中。10.如权利要求7所述的时间戳的修正系统，其特征在于：所述时长为相邻帧头的所述时间戳之差；或者，所述时长＝所述时钟周期数量×时钟周期。11.一种时钟同步系统，其特征在于：所述系统包括第一处理器和第二处理器，第一处理器的多个物理层通道收发携带同步信息及其响应信息的数据帧；所述第一处理器用于记录所述数据帧帧头的时间戳以及相邻帧头之间的时钟信息；所述第二处理器用于使用如权利要求1至4任一项所述的时间戳的修正方法对所述数据帧帧头的时间戳进行修正，得到修正的时间戳；还用于生成所述响应信息；以及根据所述修正的时间戳和所述同步信息及其响应信息进行时钟调整。12.如权利要求11所述的时钟同步系统，其特征在于：所述第一处理器和所述第二处理器之间通过数据包传输所述同步信息及其响应信息。

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