申请/专利权人:成都华微电子科技有限公司
申请日:2020-07-28
公开(公告)日:2020-10-23
公开(公告)号:CN111817695A
主分类号:H03K17/22(20060101)
分类号:H03K17/22(20060101)
优先权:
专利状态码:有效-授权
法律状态:2023.07.04#授权;2020.11.10#实质审查的生效;2020.10.23#公开
摘要:防电源抖动的上电复位电路,涉及集成电路技术,本发明包括上电触发电路,第三PMOS管、抗干扰延迟电路和计数器电路;所述抗干扰延迟电路包括一个与非门,与非门的输出端接第三PMOS管的栅极,与非门的第一输入端接第二参考点B,第二输入端通过X个串联的反相器接第二参考点B,X为大于1的偶数;与非门的输出端通过一个反相器接计数器的EN端,计数器的输出端作为上电复位电路的输出端,同时连接到一个或非门的一个输入端,或非门的另一个输入端接振荡器,或非门的输出端接计数器的计数脉冲输入端。本发明保证了内部电路的复位时间,提高了电路的可靠性。
主权项:1.防电源抖动的上电复位电路,其特征在于,包括上电触发电路100,第三PMOS管P3、抗干扰延迟电路200和计数器电路;所述上电触发电路100包括:第一NMOS管N1,其栅极和漏极接高电平端Vdd;第一PMOS管P1,其栅极接地,源极接第一NMOS管N1的源极,漏极接第一参考点A;第二NMOS管N2,其栅极和漏极接第一参考点A,源极接地;第二PMOS管P2,其栅极接第一参考点A,源极接高电平端Vdd,漏极接第二参考点B,漏极还通过一个电阻接地;第三PMOS管P3的源极接高电平端Vdd,漏极接第二参考点B,漏极还通过第一电容C1接地;所述抗干扰延迟电路200包括一个与非门,与非门的输出端接第三PMOS管P3的栅极,与非门的第一输入端接第二参考点B,第二输入端通过X个串联的反相器接第二参考点B,X为大于1的偶数;与非门的输出端通过一个反相器接计数器的EN端,计数器的输出端作为上电复位电路的输出端,同时连接到一个或非门的一个输入端,或非门的另一个输入端接振荡器,或非门的输出端接计数器的计数脉冲输入端。
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