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【发明公布】用于增强的纠错的并行信道偏斜_默升科技集团有限公司_201910633052.5 

申请/专利权人:默升科技集团有限公司

申请日:2019-07-11

公开(公告)日:2021-01-12

公开(公告)号:CN112217755A

主分类号:H04L25/14(20060101)

分类号:H04L25/14(20060101);H04L1/00(20060101)

优先权:

专利状态码:有效-授权

法律状态:2023.11.03#授权;2021.01.29#实质审查的生效;2021.01.12#公开

摘要:数字通信发射器、系统和方法可以将偏斜引入并行传输信道,以增强前向纠错FEC解码器的性能。一个说明性串行器‑解串器SerDes发射器实施例包括:分组码编码器,所述分组码编码器被配置为将输入数据块序列转换为编码数据块序列;解复用器,所述解复用器被配置为以循环方式将来自编码数据块序列的代码码元分配给多个通道,所述多个通道对应于并行传输信道;偏斜器,所述偏斜器被配置为缓冲所述多个通道以提供相应的通道延迟,所述通道延迟彼此相差不少于编码数据块周期的一半;以及多个驱动器,每个驱动器被配置为在所述并行传输信道中的相应的一个并行传输信道上传输来自所述多个通道中的一个的代码码元。

主权项:1.一种有源电缆,所述有源电缆包括电导体,所述电导体将第一收发器连接到第二收发器以在所述第一收发器与所述第二收发器之间提供并行传输信道,所述第一收发器和所述第二收发器中的每一个包括:分组码编码器,所述分组码编码器被配置为将输入数据块序列转换为编码数据块序列;解复用器,所述解复用器被配置为将来自所述编码数据块序列的代码码元以循环方式分配到多个通道;偏斜器,所述偏斜器被配置为缓冲所述多个通道以提供相应的通道延迟,所述通道延迟彼此相差不少于编码数据块周期的一半;以及多个驱动器,所述多个驱动器各自被配置为在所述并行传输信道中的相应的一个并行传输信道上传输来自所述多个通道中的一个通道的代码码元。

全文数据:

权利要求:

百度查询: 默升科技集团有限公司 用于增强的纠错的并行信道偏斜

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