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【发明授权】可重构并行处理_珠海市芯动力科技有限公司_202111190491.7 

申请/专利权人:珠海市芯动力科技有限公司

申请日:2018-03-13

公开(公告)日:2023-01-06

公开(公告)号:CN114238204B

主分类号:G06F15/78

分类号:G06F15/78

优先权:["20170314 US 62/471,340","20170315 US 62/471,367","20170315 US 62/471,368","20170315 US 62/471,372","20170317 US 62/472,579"]

专利状态码:有效-授权

法律状态:2023.01.06#授权;2022.04.12#实质审查的生效;2022.03.25#公开

摘要:提供了用于线程级并行处理的处理器、系统和方法。处理器可以包括:多个处理单元PE,其各自可以包括配置缓冲器;序列发生器,其耦合到该多个PE中的每一个的配置缓冲器并配置成将一个或多个PE配置分配给该多个PE;以及垫片内存,其耦合到多个PE并配置成存储至少一个PE执行结果以在下一PE配置期间由多个PE中的至少一个使用。

主权项:1.一种处理器,所述处理器包括:多个处理单元PE,各自具有配置成在并行线程中执行相同指令的多个算术逻辑单元ALU;以及多个内存端口MP,用于多个PE访问一个内存单元,多个MP中的每一个MP包括地址计算单元,所述地址计算单元配置成为每个线程生成相应的内存地址,以访问所述内存单元中的不同内存组;数据在MP之间路由的方向平行于数据在PE之间路由的方向;一个序列发生器,耦合到所述多个PE中的每一个PE的配置缓冲器并配置成将一个或多个PE配置分配给所述多个PE,其中每一个PE配置包括用于相应PE执行的相应解码指令和指定相应解码指令要重复执行次数的数字;所述多个MP,还用于所述多个PE访问一个内存单元,所述多个MP中的每一个MP包括地址计算单元,所述地址计算单元配置成为每个线程生成相应的内存地址,以访问所述内存单元中的不同内存组;其中,所述地址计算单元具有:耦合到一个基地址输入的第一输入,所述基地址输入提供所有线程公用的基地址;耦合到一个向量地址的第二输入,所述向量地址为每个线程单独提供地址偏移;以及耦合到一个计数器的第三输入,计数器配置用于提供线程索引;其中,所述处理器进一步包括耦合到所述序列发生器以从所述序列发生器接收数据交换盒配置的多个数据交换盒,所述多个数据交换盒中的每一个数据交换盒与所述多个PE中的一个相应PE相关联,并且配置成根据所述数据交换盒配置为所述相应PE提供输入数据切换,其中每一个所述数据交换盒配置包括指定重复应用当前设置次数的数字;其中,所述多个数据交换盒及其相关联的PE布置在多个列中,所述多个列的第一列中的第一数据交换盒耦合在垫片内存和所述多个列的第一列中的第一个PE之间,并且所述多个列的最后一列中的第二个PE耦合到所述垫片内存。

全文数据:

权利要求:

百度查询: 珠海市芯动力科技有限公司 可重构并行处理

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