申请/专利权人：三未信安科技股份有限公司;山东多次方半导体有限公司

申请日：2022-10-11

公开（公告）日：2023-01-17

公开（公告）号：CN115328832B

主分类号：G06F13/32

分类号：G06F13/32;G06F9/30

优先权：

专利状态码：有效-授权

法律状态：2023.01.17#授权;2022.11.29#实质审查的生效;2022.11.11#公开

摘要：本发明公开了一种基于PCIEDMA的数据调度系统与方法，包括：PCIEIP模块包括BAR控制器和DMA控制器；BAR控制器通过AXI‑Lite总线连接模块分别与aximm2axis模块、axis2aximm模块和算法核心模块相互连接；DMA控制器通过AXI‑MM总线连接模块分别与DDR控制模块和BlockRam控制模块相互连接；DDR控制模块与DDR存储器相互连接；BlockRam控制模块与RAM存储器相互连接；aximm2axis模块和axis2aximm模块均与算法核心模块连接；通过该系统可以高效调度主机、设备及存储三者之间的数据流转。

主权项：1.一种基于PCIEDMA的数据调度系统，其特征在于，包括：PCIEIP模块、AXI-Lite总线连接模块、aximm2axis模块、axis2aximm模块、算法核心模块、AXI-MM总线连接模块、DDR控制模块和BlockRam控制模块；其中：所述PCIEIP模块包括BAR控制器和DMA控制器；所述BAR控制器通过AXI-Lite总线连接模块分别与aximm2axis模块、axis2aximm模块和算法核心模块相互连接；所述DMA控制器通过AXI-MM总线连接模块分别与DDR控制模块和BlockRam控制模块相互连接；所述DDR控制模块与DDR存储器相互连接；所述BlockRam控制模块与RAM存储器相互连接；所述aximm2axis模块和axis2aximm模块均通过axi_stream接口与算法核心模块连接；且所述aximm2axis模块和axis2aximm模块均通过所述AXI-MM总线连接模块分别与DDR控制模块和BlockRam控制模块相互连接；所述aximm2axis模块和axis2aximm模块均通过axi_mm接口与所述AXI-MM总线连接模块连接；其中：所述aximm2axis模块用于将AXI-MM总线转化为axi-stream总线，从而实现将DDR存储器或RAM存储器中的数据搬移到算法核心模块中；所述axis2aximm模块用于将axi-stream总线转化为AXI-MM总线，从而实现将算法核心模块计算后的数据搬移到DDR存储器或RAM存储器中；所述aximm2axis模块包括：第一axi_lite接口、第一axi_mm接口和第一axi_stream接口；所述第一axi_lite接口，用于通过所述AXI-Lite总线连接模块与所述BAR控制器相互连接，实现BAR控制器与aximm2axis模块之间的数据通信；所述第一axi_mm接口，用于通过所述AXI-MM总线连接模块与所述DDR控制模块和BlockRam控制模块相互连接，实现将DDR存储器或RAM存储器中的数据搬移到aximm2axis模块中；所述第一axi_stream接口，用于连接所述算法核心模块，实现将aximm2axis模块中的数据搬移到算法核心模块中；所述aximm2axis模块还包括：第一寄存器、第一状态控制机、第一FIFO存储器、和第一数据选择器；所述第一寄存器与第一状态控制机连接；所述第一状态控制机，用于控制AXI-MM总线的读地址通道，还用于将AXI-MM总线中读数据通道的数据取出存入所述第一FIFO存储器中；所述第一FIFO存储器，用于缓存在AXI-MM总线处读到的数据，并发送至所述第一数据选择器中；所述第一数据选择器根据配置到的通道标识，将数据分配到对应的第一axi_stream接口中；所述axis2aximm模块包括第二axi_lite接口、第二axi_stream接口和第二axi_mm接口；所述第二axi_lite接口，用于通过所述AXI-Lite总线连接模块与所述BAR控制器相互连接，实现BAR控制器与axis2aximm模块之间的数据通信；所述第二axi_stream接口，用于连接所述算法核心模块，实现将算法核心模块中的数据搬移到axis2aximm模块中；所述第二axi_mm接口，用于通过所述AXI-MM总线连接模块与所述DDR控制模块和BlockRam控制模块相互连接，实现将axis2aximm模块中的数据搬移到DDR存储器或RAM存储器中；所述axis2aximm模块包括第二寄存器、第二状态控制机、第二FIFO存储器和第二数据选择器；所述第二数据选择器根据配置到的通道标识，将对应的第二axi_stream接口中的数据缓存到所述第二FIFO存储器中；所述第二状态控制机，用于将第二FIFO存储器中的数据放入到AXI-MM总线的写地址通道，还用于控制AXI-MM总线的读地址通道；所述第二寄存器与第二状态控制机连接。

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权利要求：

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