申请/专利权人：江苏和正特种装备有限公司

申请日：2021-03-02

公开（公告）日：2023-03-14

公开（公告）号：CN112994823B

主分类号：H04J3/06

分类号：H04J3/06;H04L12/40

优先权：

专利状态码：有效-授权

法律状态：2023.03.14#授权;2021.07.06#实质审查的生效;2021.06.18#公开

摘要：本发明公开一种基于VPX的高精度时钟源系统及时钟纠偏方法，系统包括：交换模块、变压器、存储器、VPX连接器以及时钟电路，其中，交换模块用于数据转发，其支持端口配置，支持IEEE802.1QVLAN协议；变压器类型为网络变压器，其用于耦合电平、增强信号驱动能力，使内部PHY与外部实现隔离；交换模块通过变压器或直接与VPX连接器相连，用于将网络状态信息引至VPX连接器；时钟电路与所述VPX连接器相连，时钟电路中包含压控晶体振荡器，其为通信系统各子设备提供稳定的时钟基准；所述存储器用于存储交换模块的驱动程序。该系统其具有多路千兆以太网、可实时调整的高精度时钟源，以太网指示灯、时钟信号指示灯可以分别指示平台内部的以太网、时钟是否处于正常工作状态。

主权项：1.一种应用于VPX的高精度时钟源系统的时钟纠偏方法，其特征在于，所述纠偏方法包括：当处理器开始进行时钟偏差比对时，首先设置一个偏差阈值Δ以及纠偏间隔时间T，当时钟偏差绝对值≤Δ时，输出控制信号CTL不变；当时钟偏差绝对值＞Δ时，输出一个新的控制信号CTL′，经过时间T后，重新对时钟偏差进行比对；当时钟偏差绝对值＞Δ时，输出一个新的控制信号CTL′的具体流程如下：对以实时时钟的变化参考值CLK′进行采样计数，计数值M为不少于2个连续输入的时钟基准信号上升沿或下降沿之间的时间间隔内采样到计数值，采用如下公式计算输出偏差值：M0=N*f0Rref；Δ′=N*Δ；e=M-M0；其中，M0为计数基准值、N为实时时钟放大倍数、f0为晶振目标输出频率、Rref为时钟基准信号频率、Δ′为计数值阈值、Δ为时钟输出频率偏差阈值；当e＞Δ′，减小输出数字量，调低压控晶振的频率；当e＜-Δ′，增大输出数字量调高压控晶振的频率；当|e|≤Δ′，频率误差在允许范围内，输出数字量保持不变；当处理器工作频率fs满足奈奎斯特采用定理，即fs＞2N*CLK′；允许晶振误差为±F，DAC位数为NDAC，频率调节精度ΔF=F2^NDAC，假设F为1000Hz，NDAC为16，则ΔF=0.015Hz＜1Hz，此时，若f0为20MHz，N为10，则处理器工作频率大于400MHz。

全文数据：

权利要求：

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