申请/专利权人：北京超摩科技有限公司

申请日：2022-12-27

公开（公告）日：2023-03-17

公开（公告）号：CN115657788B

主分类号：G06F1/08

分类号：G06F1/08;G06F13/42;H03K19/20

优先权：

专利状态码：有效-授权

法律状态：2023.03.17#授权;2023.02.17#实质审查的生效;2023.01.31#公开

摘要：本发明提供了一种高速多相时钟产生电路、串行器及电子设备，该高速多相时钟产生电路包括电性连接的倍频相位产生模块以及多相时钟重组模块；倍频相位产生模块接收多个基频时钟信号，并对其分组进行第一处理，形成至少两组倍频相位信号组；多相时钟重组装置接收至少两组倍频相位信号组中的倍频相位信号并将其进行分组重组与补偿，进而每组中的高速时钟信号的有效信号时间均大于对应的用于重组的倍频相位信号的有效信号时间。从而使得该高速时钟信号既可支持高速应用，又能解决因倍频相位产生模块带来的时延而导致的信号传输质量不好的问题。

主权项：1.一种高速多相时钟产生电路，其特征在于，包括电性连接的倍频相位产生模块以及多相时钟重组模块；其中：所述倍频相位产生模块用于接收多个基频时钟信号，并将所述多个基频时钟信号分组进行第一处理，形成至少两组倍频相位信号组，每组倍频相位信号组均包括多个倍频相位信号，且至少存在两组倍频相位信号组之间的倍频相位信号互为一一对应的反相信号；其中，所述第一处理包括占空比处理，以使得倍频相位信号的占空比小于对应的基频时钟信号的占空比；且所述多个基频时钟信号之间的相位不同，所述每组倍频相位信号组所包括的多个倍频相位信号之间的相位不同；所述多相时钟重组模块用于接收所述至少两组倍频相位信号组中的倍频相位信号，并对接收到的倍频相位信号进行分组重组，对所述倍频相位信号进行补偿，以形成多组高速时钟信号组，每组高速时钟信号组均至少包括两个相位相反的高速时钟信号，不同组的高速时钟信号之间的相位不同；所述对接收到的倍频相位信号进行分组重组，具体为：对于第i组高速时钟信号组中的两个高速时钟信号，采用的为互为一一对应的反相信号的两组倍频相位信号组中的第1组的第i-1个倍频相位信号与第2组的第i个倍频相位信号作为其中的一个高速时钟信号的用于重组的倍频相位信号；且采用第1组的第i个倍频相位信号与第2组的第i-1个倍频相位信号作为其中的另一个高速时钟信号的用于重组的倍频相位信号；其中，所述第1组中的所有倍频相位信号与所述第2组中的所有的倍频相位信号的排序为按照相位大小依序进行排序；其中高速时钟信号组的总数量为N组，第1组与第2组的倍频相位信号的数量分别为M个，i、N、M为正整数，且i≥1，N≥2，M≥N≥i。

全文数据：

权利要求：

百度查询： 北京超摩科技有限公司 高速多相时钟产生电路、串行器及电子设备

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