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【发明公布】一种降低传输延迟影响的Timer电路_西安微电子技术研究所_202310153277.7 

申请/专利权人:西安微电子技术研究所

申请日:2023-02-22

公开(公告)日:2023-05-23

公开(公告)号:CN116155089A

主分类号:H02M3/07

分类号:H02M3/07;H02M1/36;H02M1/00

优先权:

专利状态码:在审-实质审查的生效

法律状态:2023.06.09#实质审查的生效;2023.05.23#公开

摘要:本发明公开了一种降低传输延迟影响的Timer电路,包括复位模块和比较器模块;复位模块和比较器模块分别加入了两级反相器和开关管构成预偏置启动电路。当同步信号从异常状态恢复正常时,驱动器的逻辑电路会重新产生复位信号,Timer接收到该复位信号后,预偏置启动电路中的两级反相逻辑会让比较器模块的开关管导通,输出端的电平就能快速翻转,极大地降低了驱动器重新恢复工作所需的时间。由于该预偏置启动技术直接作用于Timer的输出端,直接避免了大电容的放电时间和逻辑链路的晶体管寄生效应造成的延迟影响。

主权项:1.一种降低传输延迟影响的Timer电路,其特征在于,包括复位模块和比较器模块;所述复位模块包括RC充电网络和反相器,所述的RC充放电网络包括电容C1、电阻R2和晶体管MN15;所述电阻R2的第一端连接电源电压VCC,第二端连接电容C1第一端;所述电容C1的第二端接地;所述电阻R2的第二端和晶体管MN15的漏极接输入信号VTIMER;所述晶体管MN15的栅极与反相器连接;所述晶体管MN15的源极接地,漏极连接电阻R2的阴极;所述比较器模块包括电连接的比较器电路和开关管MP6,所述开关管MP6的栅极连接Reset_bar端口,源极接电源,漏极与比较器电路连接。

全文数据:

权利要求:

百度查询: 西安微电子技术研究所 一种降低传输延迟影响的Timer电路

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