申请/专利权人：杭州长川科技股份有限公司

申请日：2023-02-24

公开（公告）日：2023-05-30

公开（公告）号：CN116185131A

主分类号：G06F1/12

分类号：G06F1/12;G06F1/08

优先权：

专利状态码：在审-公开

法律状态：2023.05.30#公开

摘要：本申请公开了一种时钟同步电路及测试机，其中，时钟同步电路包括：时钟扇出模块，用于将时基时钟信号进行扇出，形成第一时钟信号和第二时钟信号；降频模块，与时钟扇出模块连接，用于将第一时钟信号进行降频处理，形成同步触发信号；时序匹配调整模块，与时钟扇出模块连接，用于对第二时钟信号进行时序匹配调整，形成与同步触发信号具有预设时序约束关系的时基信号。该电路利用降频模块和时序匹配调整模块将时钟扇出模块扇出生成的两路时钟信号建立预设时序约束关系，这样再不需要将时基信号倍频得特别高的情况下，就可以实现在各个子板卡接收端的时钟同步。不需要逻辑器件的大规模电路设计，不需要特殊的复杂的时序编程，极大降低物料成本和人力成本。

主权项：1.一种时钟同步电路，其特征在于，包括：时钟扇出模块，用于将时基时钟信号进行扇出，形成第一时钟信号和第二时钟信号；降频模块，与所述时钟扇出模块连接，用于将所述第一时钟信号进行降频处理，形成同步触发信号；时序匹配调整模块，与所述时钟扇出模块连接，用于对所述第二时钟信号进行时序匹配调整，形成与所述同步触发信号具有预设时序约束关系的时基信号。

全文数据：

权利要求：

百度查询： 杭州长川科技股份有限公司 时钟同步电路及测试机

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