申请/专利权人:豪威科技股份有限公司
申请日:2023-10-10
公开(公告)日:2024-04-19
公开(公告)号:CN117915210A
主分类号:H04N25/40
分类号:H04N25/40;H04N25/70
优先权:["20221018 US 18/047,588"]
专利状态码:在审-公开
法律状态:2024.04.19#公开
摘要:本公开涉及算术逻辑单元中的图像信号及相位检测自动聚焦信号提取及存储。一种算术逻辑单元ALU包含前端锁存器级,其耦合到信号锁存器级,所述信号锁存器级耦合到格雷码GC到二进制级。加法器级的第一输入经耦合以接收所述GC到二进制级的输出。加法器输入锁存器级包含第一及第二加法器输入锁存器,其包含经耦合以接收所述GC到二进制级的输出的第一及第二输入。加法器输入多路复用器级包含耦合到所述加法器级的第二输入的输出及分别耦合到所述第一及第二加法器输入锁存器的输出的第一及第二输入。
主权项:1.一种算术逻辑单元ALU,其包括:前端锁存器级,其耦合到格雷码GC产生器以响应于比较器输出而锁存所述GC产生器的GC输出;信号锁存器级,其经耦合以响应于信号锁存器启用信号而锁存所述前端锁存器级的输出;GC到二进制级,其经耦合以产生锁存于所述信号锁存器级中的所述GC输出的二进制表示;加法器级,其包含第一输入及第二输入,其中所述加法器级的所述第一输入经耦合以接收所述GC到二进制级的输出,其中所述加法器级的输出响应于所述加法器级的所述第一输入及所述第二输入而产生;加法器输入锁存器级,其经耦合以锁存所述GC到二进制级的输出,其中所述加法器输入锁存器级包括:第一加法器输入锁存器,其经配置以响应于第一加法器输入锁存器启用信号而锁存所述GC到二进制级的所述输出;及第二加法器输入锁存器,其经配置以响应于第二加法器输入锁存器启用信号而锁存所述GC到二进制级的所述输出;及加法器输入多路复用器级,其中所述加法器输入多路复用器级的第一输入经耦合以接收所述第一加法器输入锁存器的输出,其中所述加法器输入多路复用器级的第二输入经耦合以接收所述第二加法器输入锁存器的输出,其中所述加法器级的所述第二输入经耦合以接收所述加法器输入多路复用器级的输出。
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百度查询: 豪威科技股份有限公司 算术逻辑单元中的图像信号及相位检测自动聚焦信号提取及存储
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