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申请/专利权人：华中科技大学
申请日：2024-01-18
公开（公告）日：2024-05-17
公开（公告）号：CN118051390A
主分类号：G06F11/22
分类号：G06F11/22;G06F11/273
优先权：
专利状态码：在审-实质审查的生效
法律状态：2024.06.04#实质审查的生效;2024.05.17#公开
摘要：本发明公开了一种针对FPGA配置存储器的外部错误注入设备及应用，属于芯片测试技术领域，包括属于软件部分想软核处理器和属于硬件部分的配置帧读写模块；本发明通过软硬结合的方式实现外部错误注入，软件部分接收并解析灵活多变的信息，并输入至硬件部分，进而驱动硬件部分实现其固定功能；当用户要求发生变化或者FPGA型号发生变化时，只需要将相应的信息发送至与软核处理器即可，无需重新烧写对应的硬件程序到待注入FPGA中，注入速度较快、可扩展性较强；与此同时，本发明并未在FPGA上例化具备配置帧读写功能的IP核，不易受到环境因素影响；基于此，本发明提供了一种不易受环境因素影响、且注入速度较快、可扩展性较强的外部错误注入设备。
主权项：1.一种针对FPGA配置存储器的外部错误注入设备，其特征在于，包括：软核处理器和配置帧读写模块；所述软核处理器中存储有与待注入FPGA的型号相对应的JTAG控制信号；所述软核处理器用于在接收到外部注入指令后，将与待注入FPGA的型号相对应的JTAG控制信号输入至所述配置帧读写模块中；使能所述配置帧读写模块的读使能端，并将从所述外部注入指令解析到的待注入FPGA的目标地址输入至所述配置帧读写模块；所述配置帧读写模块用于当读使能端有效时，读取待注入FPGA目标地址处的目标帧数据，并回传至所述软核处理器；所述软核处理器还用于当接收到目标帧数据后，基于从外部注入指令解析到的错误注入模式对目标帧数据进行修改，生成注入帧数据，并使能所述配置帧读写模块的写使能端；所述配置帧读写模块还用于当写使能端有效时，从所述软核处理器中读取所述注入帧数据，并将所述注入帧数据写入至待注入FPGA的目标地址处。
全文数据：
权利要求：
百度查询： 华中科技大学 一种针对FPGA配置存储器的外部错误注入设备及应用
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