上海华虹宏力半导体制造有限公司赵锋获国家专利权
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龙图腾网获悉上海华虹宏力半导体制造有限公司申请的专利测量器件OCV参数的电路及测试系统获国家发明授权专利权,本发明授权专利权由国家知识产权局授予,授权公告号为:CN114460345B 。
龙图腾网通过国家知识产权局官网在2025-06-06发布的发明授权授权公告中获悉:该发明授权的专利申请号/专利号为:202210008468.X,技术领域涉及:G01R15/12;该发明授权测量器件OCV参数的电路及测试系统是由赵锋;周喆;邵博闻;徐佳斌设计研发完成,并于2022-01-06向国家知识产权局提交的专利申请。
本测量器件OCV参数的电路及测试系统在说明书摘要公布了:本发明提供一种测量器件OCV参数的电路及测试系统,其中,测量器件OCV参数的电路包括:数据延时模块、第一时钟延时模块、第二时钟延时模块、电平选择模块、数据选择模块和平衡寄存器,测试时钟信号分别提供给所述数据延时模块、所述第一时钟延时模块和所述第二时钟延时模块,最后经所述平衡寄存器输出第四数据信号。本申请通过比较所述第四数据信号和所述测试时钟信号的波形获取总的延时时间,并且通过采集第二时钟延时模块和数据选择模块输出的信号的波形第一中间信号、第二中间信号的波形分别获取第二时钟延时模块和数据选择模块的延时时间,从而通过计算能够获取待测量电路的时序偏差OCV参数。
本发明授权测量器件OCV参数的电路及测试系统在权利要求书中公布了:1.一种测量器件OCV参数的电路,其特征在于,包括:数据延时模块,用于接收外部输入的测试时钟信号和第一控制信号,并根据所述第一控制信号对所述测试时钟信号进行延时处理以向后级输出第一延时数据信号;第一时钟延时模块,用于接收外部输入的所述测试时钟信号和第二控制信号,并根据所述第二控制信号对所述测试时钟信号进行延时处理以向后级输出第一延时时钟信号;第二时钟延时模块,用于接收外部输入的所述测试时钟信号和第三控制信号,并根据所述第三控制信号对所述测试时钟信号进行延时处理以向后级输出第二延时时钟信号,以及输出用于测量延时的第一中间信号;电平选择模块,用于接收所述数据延时模块输出的所述第一延时数据信号和外部输入的第四控制信号,并根据所述第四控制信号对所述第一延时数据信号进行逻辑运算处理以向后级输出第二延时数据信号;数据选择模块,用于接收外部输入的第一选择信号和第二选择信号、所述电平选择模块输出的所述第二延时数据信号、所述第一时钟延时模块输出的所述第一延时时钟信号以及待测量电路输出的第一数据信号和第二数据信号,并根据所述第一选择信号和所述第二选择信号对所述第二延时数据信号、所述第一延时时钟信号、所述第一数据信号和所述第二数据信号进行延时抵消处理以向后级输出第三数据信号,以及输出用于测量延时的第二中间信号;以及,平衡寄存器,用于接收所述第二时钟延时模块输出的所述第二延时时钟信号和所述数据选择模块输出的所述第三数据信号,并向后级输出第四数据信号;其中,通过比较所述第四数据信号和所述测试时钟信号的波形获取总的延时时间、通过采集第二时钟延时模块和数据选择模块输出的信号的波形分别获取所述第二时钟延时模块和所述数据选择模块的延时时间,并通过计算以获取待测量电路的OCV参数,其中,所述OCV参数包括:setup时间、hold时间以及CLK至Q的时间;其中,所述数据选择模块包括:多个第二选择器、多路复用阵列和第二反相器,所述多路复用阵列包括多个输入端和一输出端,其中两个输入端接收外部输入的第一选择信号和第二选择信号,其余输入端分别对应地与各所述第二选择器的输出端相连,所述多路复用阵列的输出端连接至所述第二反相器的输入端,并连接至所述平衡寄存器的数据输入端以给所述平衡寄存器提供所述第三数据信号,所述第二反相器的输出端连接至各所述第二选择器的一输入端以给各所述第二选择器提供所述第二中间信号,各所述第二选择器的另一输入端分别接收待测量电路输出的第一数据信号和第二数据信号以及所述电平选择模块输出的所述第二延时数据信号、所述第一时钟延时模块输出的所述第一延时时钟信号;其中,通过控制所述第二选择器的不同的测试模式,选择所述第二中间信号或者所述第一数据信号、所述第二数据信号、所述第二延时数据信号和所述第一延时时钟信号经由所述第二选择器提供给所述多路复用阵列;其中,通过测量所述第二反相器的输出端输出的第二中间信号的波形的周期,获取所述数据选择模块的延时时间;其中,所述多路复用阵列包括:多个第二延时单元、多个多路复用单元和多个逻辑单元,多个所述多路复用单元依次相连,多个所述第二延时单元的输出端连接至首个所述多路复用单元的多个输入端,所述逻辑单元两两一组,各组逻辑单元对应控制一所述多路复用单元,各组逻辑单元分别接收外部输入的所述第一选择信号和所述第二选择信号,并对所述第一选择信号和所述第二选择信号进行逻辑运算处理以向对应的所述多路复用单元输出第四控制信号和第五控制信号;其中,所述第一数据信号、所述第二数据信号、所述第二延时数据信号和所述第一延时时钟信号分别由所述第二选择器输入,并由末个所述多路复用单元输出,各路径信号经过所述多路复用单元的四端数量相同,以抵消所述第一数据信号、所述第二数据信号、所述第二延时数据信号和所述第一延时时钟信号从输入到输出的延时时间。
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