申请/专利权人：意法半导体(鲁塞)公司

申请日：2020-10-22

公开（公告）日：2021-04-09

公开（公告）号：CN212933350U

主分类号：G05F3/26(20060101)

分类号：G05F3/26(20060101)

优先权：["20191023 FR 1911833"]

专利状态码：失效-避免重复授权放弃专利权

法律状态：2024.01.30#避免重复授权放弃专利权;2021.04.09#授权

摘要：本公开的实施例涉及一种电子设备，包括：第一晶体管，被连接在第一节点与输出端子之间的；以及第一电流源，被连接在第一节点与供电轨之间。一电路，包括：第二电流源，被连接在供电轨与第二节点之间；运算放大器，具有非反相输入，非反相输入被配置成接收电位设定点；以及第二晶体管，被连接在第二节点与运算放大器的反相输入之间。运算放大器的输出连接到第二晶体管的控制端子，并且还连接到第一晶体管的控制端子。

主权项：1.一种电子设备，其特征在于，包括：第一供电轨；第一晶体管，被连接在第一节点与输出端子之间，所述输出端子通过驱动电路而被耦合到所述第一供电轨；第一电流源，被连接在所述第一节点与第二供电轨之间；以及第一电路，包括：第二电流源，被连接在所述第二供电轨与第二节点之间；运算放大器，具有非反相输入，所述非反相输入被配置成接收电位设定点；以及第二晶体管，被连接在所述第二节点与所述运算放大器的反相输入之间，其中所述反相输入通过偏置电路而被耦合到所述第一供电轨；其中控制信号被施加到所述第二晶体管的控制端子，并且还被施加到所述第一晶体管的控制端子，所述控制信号在所述运算放大器的输出处被生成。

全文数据：

权利要求：

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