申请/专利权人：合肥芯福传感器技术有限公司

申请日：2021-07-05

公开（公告）日：2021-10-08

公开（公告）号：CN113489485A

主分类号：H03K21/02(20060101)

分类号：H03K21/02(20060101);H03K21/08(20060101)

优先权：

专利状态码：在审-实质审查的生效

法律状态：2022.06.03#实质审查的生效;2021.10.08#公开

摘要：本申请公开了一种格雷码计数器电路，通过逻辑电路或触发器搭建格雷码输出单元，多个格雷码输出单元构成格雷码计数器电路。相较于传统格雷码计数器电路，本申请提供的格雷码计数器电路无需先搭建二进制计数器再通过逻辑电路转换成格雷码格式，电路功耗较小，电路所包含元件较少，电路结构较为简单。

主权项：1.一种格雷码计数器电路，其特征在于，所述格雷码计数器电路包括：N个输出单元用于输出N位格雷码，其中，N为正整数；所述N个输出单元包括第一输出单元至第N输出单元；第一输出单元，包括：第一触发器和第二触发器，所述第一触发器时钟端连接时钟信号，所述第二触发器的时钟端连接所述第一触发器反相输出端；第二输出单元，包括：第一与门，所述第一与门的第一输入端连接所述第一触发器的正相输出端，所述第一与门的第二输入端连接所述第二触发器的正相输出端；第三触发器，所述第三触发器的时钟端连接所述第一与门输出端；第三输出单元，包括：第一反相器，所述第一反相器的输入端连接第二触发器的正相输出端；第二与门，所述第二与门的第一输入端连接所述第一触发器的正相输出端，所述第二与门的第二输入端连接所述第三触发器的正相输出端，所述第二与门的第三输入端连接所述第一反相器的输出端；第四触发器，所述第四触发器的时钟端连接第二与门的输出端；第M输出单元，其中4≤M≤N且M为正整数，包括：第M-3时钟控制单元，所述第M-3时钟控制单元的输入端连接触发器输出端；第M-1与门，所述第M-1与门的第一输入端连接所述第一触发器的正相输出端，所述第M-1与门的第二输入端连接所述第M触发器的正相输出端，所述第M-1与门的第三输入端连接所述第M-3时钟控制单元的输出端；第M+1触发器，所述第M+1触发器的时钟端连接第M-1与门的输出端；所述每一个触发器的反相输出端连接触发器自身的数据端；所述每一个触发器的复位端连接复位信号。

全文数据：

权利要求：

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