申请/专利权人：湖南航天机电设备与特种材料研究所

申请日：2023-11-13

公开（公告）日：2024-03-19

公开（公告）号：CN117724321A

主分类号：G04G7/00

分类号：G04G7/00;G04F5/14;G01C21/16

优先权：

专利状态码：在审-实质审查的生效

法律状态：2024.04.05#实质审查的生效;2024.03.19#公开

摘要：本发明涉及惯导技术领域，公开一种惯导系统基于外部铷钟的强制对时装置及方法，以提高设备之间数据同步的稳定性和可靠性。具体方法是对输入的外部铷钟进行滤波处理，使用本地晶振对滤波后的外部铷钟单个周期进行计数统计得到相应的计数值，判定该计数值是否在相对应的外部铷钟理论值所允许波动的上下阈值范围内，如果是，在对滤波后铷钟信号进行同步化处理，在外部铷钟下降沿的上阈值和下阈值之间的时间窗口进行强制对时，生成并锁定与本地时钟保持一定的相位关系的新时钟信号，其中，该新时钟信号相对于本地晶振单个周期的计数值为相对应的外部铷钟理论值，且在该新时钟信号的启用时刻将外部铷钟与本地时钟对齐。

主权项：1.一种惯导系统基于外部铷钟的强制对时装置，其特征在于，包括DSP模块和FPGA模块，其中：所述DSP模块，用于在上电并获取到铷钟启动命令后，从所述FPGA模块获取外部铷钟单个周期的计数值，判定该计数值是否在相对应的外部铷钟理论值所允许波动的上下阈值范围内，如果是，将外部铷钟下降沿的上阈值和下阈值写入所述FPGA模块，并向所述FPGA模块输出对时启动指令；所述FPGA模块，用于对输入的外部铷钟进行滤波处理后，使用本地晶振对滤波后的外部铷钟单个周期进行计数统计得到相应的计数值，并将该计数值输出给所述DSP模块；以及在对滤波后铷钟信号进行同步化处理后，在外部铷钟下降沿的上阈值和下阈值之间的时间窗口进行强制对时，生成并锁定与本地时钟保持一定的相位关系的新时钟信号；其中，该新时钟信号相对于本地晶振的单个周期的计数值为相对应的外部铷钟理论值，且在该新时钟信号的启用时刻将外部铷钟与本地时钟对齐；其中，对时前时钟为本地晶振所输出系统时钟分频产生的一个与本地时钟同频率的外部铷钟参考时钟信号。

全文数据：

权利要求：

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