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【发明授权】一种基于宇称时间对称原理的环形器_东南大学_202310147244.1 

申请/专利权人:东南大学

申请日:2023-02-22

公开(公告)日:2024-01-30

公开(公告)号:CN116259944B

主分类号:H01P1/38

分类号:H01P1/38

优先权:

专利状态码:有效-授权

法律状态:2024.01.30#授权;2023.06.30#实质审查的生效;2023.06.13#公开

摘要:本发明公开一种基于宇称时间对称原理的环形器,其由两组宇称时间PT对称模块串联构成,每组PT对称模块包括:电感‑电容‑正电阻并联谐振的损耗谐振器,可调耦合模块,以及电感‑电容‑负电阻并联的增益谐振器;其中损耗谐振器与增益谐振器通过可调电容耦合连接构成PT对称模块。其中一组PT对称模块的增益谐振器与另一组的损耗谐振器相连,构成环形器的输入输出端口。其中一组PT对称模块剩余的损耗谐振器构成环形器的输入端口,另一组剩余的增益谐振器构成环形器的输出端口。通过改变可调耦合电容实现传输频率调谐。该系统具有高非互易比,低插入损耗等优点。

主权项:1.一种基于宇称时间对称原理的环形器,其特征在于,该环形器由两组宇称时间对称模块即第一耦合模块A和第二耦合模块B串联构成,每个宇称时间对称模块都包含了一个损耗谐振器,一个增益谐振器,以及连接它们的可调电容;其中,第一组宇称时间对称模块的第一增益谐振器2与第二组PT对称模块的第二损耗谐振器3相连,该连接端构成环形器的输入输出端口IO;第一组宇称时间对称模块的第一损耗谐振器1的输入端构成环形器的输入端口IN,第二组宇称时间对称模块的第二增益谐振器4构成环形器的输出端口OUT;每组宇称时间对称模块中的损耗谐振器和增益谐振器都通过可调电容耦合在一起,通过改变可调电容来改变损耗谐振器与增益谐振器之间的耦合系数,从而实现传输频率调谐;所述第一耦合模块A中的第一损耗谐振器1由第一电感L1、第一电容C1和第一正电阻R1并联组成;其中一端接地,另一端接输入端口IN;所述第二耦合模块B中的第二损耗谐振器3由第三电感L22、第三电容C22和第二正电阻R3并联组成;其中一端接地,另一端接输入输出端口IO;所述第一耦合模块A中的第一增益谐振器2由第二电感L21、第二电容C21和第一负电阻-R2并联组成;其中一端接地,另一端接输入输出端口IO;所述第二耦合模块B中的第二增益谐振器4由第四电感L3、第四电容C3和第二负电阻-R4并联组成;其中一端接地,另一端接输出端口OUT。

全文数据:

权利要求:

百度查询: 东南大学 一种基于宇称时间对称原理的环形器

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