申请/专利权人：白盒子(上海)微电子科技有限公司

申请日：2023-08-30

公开（公告）日：2024-03-19

公开（公告）号：CN117081607B

主分类号：H03M13/11

分类号：H03M13/11

优先权：

专利状态码：有效-授权

法律状态：2024.03.19#授权;2023.12.05#实质审查的生效;2023.11.17#公开

摘要：本发明涉及一种NRLDPC部分校验矩阵编译码指示信息获取方法，包括：接收编译码及速率匹配相关参数；根据基础矩阵BG的类型确定进入速率匹配循环缓存中的信息比特及核心校验比特的长度；根据进入速率匹配循环缓存中的信息比特、填充比特以及核心校验比特的相对位置关系，确定从速率匹配起始位置k0开始到速率匹配缓存大小Ncb的过程中，扩展校验比特的起始位置exp_start，以及所包含的信息比特及核心校验比特长度syscore；基于扩展校验比特的起始位置exp_start、所包含的信息比特及核心校验比特长度syscore，确定编译码需要传输的扩展校验比特的行指示。本发明减少了高码率时硬件资源的消耗及时延的损耗。

主权项：1.一种NRLDPC部分校验矩阵编译码指示信息获取方法，其特征在于，包括以下步骤：接收编译码及速率匹配相关参数；所述编译码及速率匹配相关参数包括提升因子Zc、基础矩阵BG的类型、信息比特净荷长度Kd、填充比特长度F、速率匹配缓存大小Ncb、速率匹配起始位置k0、以及速率匹配长度Er；根据基础矩阵BG的类型确定进入速率匹配循环缓存中的信息比特及核心校验比特的长度；根据进入速率匹配循环缓存中的信息比特、填充比特以及核心校验比特的相对位置关系，确定从速率匹配起始位置k0开始到速率匹配缓存大小Ncb的过程中，扩展校验比特的起始位置exp_start，以及所包含的信息比特及核心校验比特长度syscore；根据速率匹配长度Er、速率匹配缓存大小Ncb、以及扩展校验比特的起始位置exp_start、所包含的信息比特及核心校验比特长度syscore，确定编译码需要传输的扩展校验比特的行指示，具体为：当速率匹配长度Er减去进入速率匹配循环缓存中的信息比特加核心校验比特长度Nsyscore小于或等于所述扩展校验比特的起始位置exp_start到速率匹配缓存大小Ncb的长度时，参与编译码的扩展校验比特行指示的开始位置Start＝exp_start-NsyscoreZc，参与编译码的扩展校验比特行指示的结束位置End＝Start+ceilEr-syscoreZc；当速率匹配长度Er减去进入速率匹配循环缓存中的信息比特加核心校验比特长度Nsyscore大于所述扩展校验比特的起始位置exp_start到速率匹配缓存大小Ncb的长度时，扩展校验比特首先从所述扩展校验比特的起始位置exp_start开始，直到速率匹配缓存大小Ncb结束，随后会继续从循环缓存的起始位置继续取数据，但如果只取用了部分信息比特及核心校验比特，没有再取到扩展校验比特时，则参与编译码的扩展校验比特行指示的开始位置Start＝exp_start-NsyscoreZc，参与编译码的扩展校验比特行指示的结束位置End＝Start+ceilNcb-exp_startZc；当从循环缓存起始位置取数据，将信息比特及核心校验比特全部取出，并继续取用扩展校验比特，但未超过第一次取数据时扩展校验比特的起始位置exp_start时，参与编译码的第一次扩展校验比特行指示的开始位置Start1＝exp_start-NsyscoreZc，参与编译码的第一次扩展校验比特行指示的结束位置End1＝Start1+ceilNcb-exp_startZc，参与编译码的第二次扩展校验比特行指示的开始位置Start2＝0，参与编译码的第二次扩展校验比特行指示的结束位置End2＝Start2+ceilEr-Ncb-exp_start+syscore+Nsyscore-FZc；当速率匹配长度Er大于速率匹配缓存大小Ncb减去填充比特长度F时，扩展校验比特全部都需要参与编译码，参与编译码的扩展校验比特行指示的开始位置Start＝0，参与编译码的扩展校验比特行指示的结束位置End＝Start+ceilNcb-NsyscoreZc；其中，ceil表示向上取整。

全文数据：

权利要求：

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