申请/专利权人：上海合芯数字科技有限公司;合芯科技有限公司

申请日：2023-11-01

公开（公告）日：2024-03-22

公开（公告）号：CN117742793A

主分类号：G06F9/38

分类号：G06F9/38

优先权：

专利状态码：在审-实质审查的生效

法律状态：2024.04.09#实质审查的生效;2024.03.22#公开

摘要：本申请提供的数据缓存指令的指令合并电路、方法及芯片，包括：第一确定模块，用于响应于当前时刻下接收到的第一指令，确定第一指令指示的缓存地址、第一线程标识以及指令类型；第一指令表征需要进行数据缓存处理；第一线程标识为执行第一指令的线程的标识；第二确定模块，用于若确定指令类型为可合并类型，则在第一队列中，确定具有缓存地址和第一线程标识的数据缓存指令为第二指令；第一队列中包括至少一个数据缓存指令；合并模块，用于若确定第一指令和第二指令可以进行合并，则合并第一指令和第二指令，得到合并后的指令；替换模块，用于基于合并后的指令替换第一队列中的第二指令以确保数据准确缓存，提高指令存储队列的资源利用率。

主权项：1.一种数据缓存指令的指令合并电路，其特征在于，包括：第一确定模块，用于响应于当前时刻下接收到的第一指令，确定所述第一指令指示的缓存地址、第一线程标识以及指令类型；所述第一指令表征需要进行数据缓存处理；所述缓存地址用于指示待缓存数据对应的缓存行的地址；所述第一线程标识为执行所述第一指令的线程的标识；第二确定模块，用于若确定所述指令类型为可合并类型，则在第一队列中，确定具有所述缓存地址和所述第一线程标识的数据缓存指令为第二指令；所述第一队列中包括至少一个数据缓存指令；合并模块，用于若确定所述第一指令和所述第二指令可以进行合并，则合并所述第一指令和所述第二指令，得到合并后的指令；替换模块，用于基于所述合并后的指令替换所述第一队列中的所述第二指令。

全文数据：

权利要求：

百度查询： 上海合芯数字科技有限公司;合芯科技有限公司 数据缓存指令的指令合并电路、方法及芯片

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