申请/专利权人：江苏时代全芯存储科技股份有限公司;铨芯科技股份有限公司

申请日：2019-12-05

公开（公告）日：2020-07-03

公开（公告）号：CN210924661U

主分类号：G06N3/063(20060101)

分类号：G06N3/063(20060101)

优先权：

专利状态码：有效-授权

法律状态：2020.07.03#授权

摘要：类神经电路包含突触电路及后神经元电路。突触电路包含相变化元件且接收第一脉冲信号及第二脉冲信号。后神经元电路包含输入端、输出端及积电端。积电端依据第一脉冲信号充电至一膜电位。后神经元电路还包含第一控制电路、第二控制电路、第一延迟电路及第二延迟电路。第一控制电路依据膜电位于输出端产生激发信号。第二控制电路耦接输出端且依据激发信号产生第一控制信号。第一延迟电路延迟激发信号以产生第二控制信号。第二延迟电路延迟第二控制信号以产生第三控制信号。第一控制信号与第三控制信号控制积电端的电压位准，及维持积电端在固定电压的期间。第二控制信号协同第二脉冲信号以控制相变化元件的状态，进而决定类神经电路的权重。

主权项：1.一种类神经电路，其特征在于，包含：一突触电路，包含一相变化元件且用以接收一第一脉冲信号以及一第二脉冲信号；以及一后神经元电路，耦接该突触电路，其中该后神经元电路包含一输入端、一输出端与一积电端，其中该积电端依据该第一脉冲信号充电至一膜电位，该后神经元电路还包含：一第一控制电路，耦接于该积电端以及该输出端之间，该第一控制电路用以依据该膜电位于该输出端产生一激发信号；一第二控制电路，耦接该输出端，该第二控制电路用以依据该激发信号产生一第一控制信号；一第一延迟电路，用以延迟该激发信号以产生一第二控制信号；以及一第二延迟电路，用以延迟该第二控制信号以产生一第三控制信号；其中该第一控制信号与该第三控制信号用以控制该积电端的电压位准，以及维持该积电端在一固定电压的期间，该第二控制信号用以协同该第二脉冲信号以控制该相变化元件的状态，进而决定该类神经电路的一权重。

全文数据：

权利要求：

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