申请/专利权人:南京芯驰半导体科技有限公司
申请日:2022-06-15
公开(公告)日:2023-05-26
公开(公告)号:CN114756419B
主分类号:G06F11/22
分类号:G06F11/22;H03K5/01;H03K5/156;H03K5/24;H03K21/08
优先权:
专利状态码:有效-授权
法律状态:2023.05.26#授权;2022.08.02#实质审查的生效;2022.07.15#公开
摘要:一种参考时钟异常自检电路,包括,时钟接收及整形模块,用于对接收的参考时钟信号去噪整形处理;分频模块,用于将去噪整形后的参考时钟信号分频,获取参考时钟周期信号;时钟周期采样模块,用于将所述参考时钟周期信号转换为连续的采样电压;比较器,用于将所述采样电压转换为逻辑信号;逻辑锁存输出模块,根据所述逻辑信号,生成时钟状态指示信号输出。本申请还提供一种参考时钟异常自检方法,无需SOC系统的外部控制,对参考时钟快速内部自检,还可以精确地检测时钟的频偏范围,有效节省芯片面积,提高检测的可靠性,满足功能安全需求。
主权项:1.一种参考时钟异常自检电路,其特征在于,包括:时钟接收及整形模块,用于对接收的参考时钟信号去噪整形处理;分频模块,包括,二分频器、反相器,去噪整形后的参考时钟信号经过所述二分频器、所述反相器后,得到一对占空比为50%的参考时钟周期信号;两个时钟周期采样模块,对所述一对占空比为50%的参考时钟周期信号分别进行周期采样,利用时钟开关控制电容的充放电,获取参考时钟对应的采样电压;比较器,用于将所述采样电压转换为逻辑信号;逻辑锁存输出模块,包括,与非门、反相器、延迟器和D触发器,将所述比较器输出的逻辑信号经过组合逻辑得到reset信号,经过D触发器输出时钟状态指示信号;所述与非门包括第一与非门和第二与非门,所述反相器包括第一反相器和第二反相器;所述第一与非门的输入端连接所述比较器输出端,其输出端连接所述第一反相器的输入端;所述第一反相器的输出端连接所述延迟器的输入端;所述延迟器的输出端,分别与所述第二与非门的一个输入端、所述D触发器的输入端相连接;所述第二与非门的另一个输入端连接使能信号,其输出端连接所述第二反相器的输入端;所述第二反相器的输出端连接所述D触发器的使能输入端;所述D触发器的时钟输入端连接参考时钟周期信号,其输出端输出时钟状态指示信号。
全文数据:
权利要求:
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