申请/专利权人：芯和半导体科技(上海)股份有限公司

申请日：2023-10-10

公开（公告）日：2023-12-12

公开（公告）号：CN117217024A

主分类号：G06F30/20

分类号：G06F30/20;G06F16/9035

优先权：

专利状态码：在审-实质审查的生效

法律状态：2023.12.29#实质审查的生效;2023.12.12#公开

摘要：本发明提供的一种EDA模型按照连通域分Nets的实现方法，所述实现方法包括：步骤S1：筛选有效数据；步骤S2：遍历所述有效数据；步骤S3：进行Net的去重与合并；步骤S4：判断是否存在原始Nets，如果是，执行步骤S5；否则，执行步骤S6；步骤S5：用原始Nets数据对自动分Nets的数据进行设定；步骤S6：对没有设定过的分Nets数据按照规则进行设定；步骤S7：更新元器件的Net属性和颜色，更新视图。实现了对模型的导体连通性自动识别并分组，还能够手动设置连通域分组，进行合并、删除、新增连通域。辅助对模型数据的检查判断。

主权项：1.一种EDA模型按照连通域分Nets的实现方法，其特征在于，所述实现方法包括：步骤S1：筛选有效数据；步骤S2：遍历所述有效数据；步骤S3：进行Net的去重与合并；步骤S4：判断是否存在原始Nets，如果是，执行步骤S5；否则，执行步骤S6；步骤S5：用原始Nets数据对自动分Nets的数据进行设定；步骤S6：对没有设定过的分Nets数据按照规则进行设定；步骤S7：更新元器件的Net属性和颜色，更新视图。

全文数据：

权利要求：

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