申请/专利权人：数据通信科学技术研究所;兴唐通信科技有限公司;北京通和实益电信科学技术研究所有限公司

申请日：2022-06-22

公开（公告）日：2023-12-29

公开（公告）号：CN117313113A

主分类号：G06F21/60

分类号：G06F21/60;G06F7/501

优先权：

专利状态码：在审-实质审查的生效

法律状态：2024.01.16#实质审查的生效;2023.12.29#公开

摘要：本发明涉及一种基于进位保留加法器的模加模减加速装置及加密设备，模加模减加速装置包括模加加速模块和模减加速模块；模加加速模块通过三级级联的数据压缩电路对输入的加数和加数进行以数值P为模的相加输出模加结果，其中第一级数据压缩电路采用四输入CSA单元进行模加压缩处理，第二、三级数据压缩电路利用三输入CSA单元进行模加压缩处理；模减加速模块对减数进行按位取反后再通过四级级联的数据压缩电路对输入的被减数和取反后的减数进行以数值P为模的相加输出模减结果，其中第一级数据压缩电路采用四输入CSA单元进行模加压缩处理，第二、三、四级数据压缩电路采用三输入CSA单元进行模加压缩处理。本发明实现模加模减运算加速，提高了电路频率。

主权项：1.一种基于进位保留加法器的模加模减加速装置，在加密设备的数据处理中，实现对加密数据的模加和模减的加速处理，其特征在于，包括：模加加速模块和模减加速模块；所述模加加速模块，通过三级级联的数据压缩电路，对输入的加数XSx，Cx和加数YSy，Cy进行以数值P为模的相加，输出模加结果S+z，C+z，其中，第一级数据压缩电路采用四输入CSA单元进行模加压缩处理，第二、三级数据压缩电路利用三输入CSA单元进行模加压缩处理；所述模减加速模块；对减数YSy，Cy进行按位取反后得到～Y～Sy，～Cy；再通过四级级联的数据压缩电路，对输入的被减数XSx，Cx和～Y～Sy，～Cy进行以数值P为模的相加，输出模减结果S-z，C-z，其中，第一级数据压缩电路采用四输入CSA单元进行模加压缩处理，第二、三、四级数据压缩电路采用三输入CSA单元进行模加压缩处理。

全文数据：

权利要求：

百度查询： 数据通信科学技术研究所;兴唐通信科技有限公司;北京通和实益电信科学技术研究所有限公司 基于进位保留加法器的模加模减加速装置及加密设备

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