申请/专利权人：沐曦科技(成都)有限公司

申请日：2023-11-30

公开（公告）日：2023-12-29

公开（公告）号：CN117313604A

主分类号：G06F30/3315

分类号：G06F30/3315;G06F111/04;G06F119/12

优先权：

专利状态码：有效-授权

法律状态：2024.02.06#授权;2024.01.16#实质审查的生效;2023.12.29#公开

摘要：本申请提供一种时序例外约束检查方法、装置、系统及存储介质，涉及集成电路设计领域。时序例外约束检查方法包括：获取芯片的约束文件；提取所述约束文件中的时序例外约束的对应数据；所述时序例外约束的对应数据包括该时序例外约束的约束条件和该时序例外约束涉及电路的路径；统计所述约束条件的约束条件数量和所述路径的路径数量；将每一个时序例外约束的所述约束条件数量和所述路径数量，与该时序例外约束的标识信息关联记录于可视化报表中。通过提取约束文件中的时序例外约束并统计约束条件和路径，将约束条件数量和路径数量与时序例外约束的标识信息关联记录于可视化报表，可视化报表便于查看与核对，可以有效提高时序例外约束检查的效率。

主权项：1.一种时序例外约束检查方法，其特征在于，包括：获取芯片的约束文件；提取所述约束文件中的时序例外约束的对应数据；所述时序例外约束的对应数据包括该时序例外约束的约束条件和该时序例外约束涉及电路的路径；统计所述约束条件的约束条件数量和所述路径的路径数量；将每一个时序例外约束的所述约束条件数量和所述路径数量，与该时序例外约束的标识信息关联记录于可视化报表中。

全文数据：

权利要求：

百度查询： 沐曦科技(成都)有限公司 时序例外约束检查方法、装置、系统及存储介质

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