申请/专利权人：深圳市山海半导体科技有限公司

申请日：2023-12-29

公开（公告）日：2024-04-09

公开（公告）号：CN117559999B

主分类号：H03M1/08

分类号：H03M1/08;H03M1/46

优先权：

专利状态码：有效-授权

法律状态：2024.04.09#授权;2024.03.01#实质审查的生效;2024.02.13#公开

摘要：本申请涉及一种逐次逼近型模数转换器及模数转换处理方法，属于模数转换技术领域，用于解决现有模数转换器有效位数受限于量化噪声的技术问题。逐次逼近型模数转换器包括DAC电容阵列、噪声整形电路、比较器和SAR逻辑单元，所述噪声整形电路包括一阶噪声整形电路和二阶噪声整形电路，在量化阶段结束后的残差存储阶段，所述一阶噪声整形电路的信号输入端和二阶噪声整形电路的信号输入端按照存储时序顺次连接到所述DAC电容阵列的输出端，对量化阶段结束产生的残差电压分次存储；所述二阶噪声整形电路的信号输出端和所述一阶噪声整形电路的信号输出端在下一量化阶段分别连接所述比较器的第一输入端和第二输入端。本申请实施例提高了有效位数及精度。

主权项：1.一种逐次逼近型模数转换器，包括DAC电容阵列、比较器和SAR逻辑单元，所述DAC电容阵列的输入端连接模拟输入信号，所述比较器的输出端连接所述SAR逻辑单元，所述SAR逻辑单元输出控制信号给所述DAC电容阵列；其特征在于，在所述DAC电容阵列与所述比较器之间还包括噪声整形电路，所述噪声整形电路包括一阶噪声整形电路和二阶噪声整形电路，其中，在量化阶段结束后的残差存储阶段，所述一阶噪声整形电路的信号输入端和二阶噪声整形电路的信号输入端按照存储时序先后顺次连接到所述DAC电容阵列的输出端，对量化阶段结束产生的残差电压分次存储；所述二阶噪声整形电路的信号输出端和所述一阶噪声整形电路的信号输出端在下一量化阶段分别连接所述比较器的输入端，使所述比较器在下一量化阶段的逐次比较过程中减去存储的当前量化阶段的残差电压；所述模拟输入信号为差分信号，包括同相模拟输入信号和反相模拟输入信号；DAC电容阵列的输出端包括同相输出端和反相输出端；对应地，所述比较器的输入端包括一对同相输入端和一对反相输入端；所述噪声整形电路包括同相噪声整形电路和反相噪声整形电路；在量化阶段结束后的残差存储阶段，基于存储时序，同相一阶噪声整形电路的信号输入端和反相一阶噪声整形电路的信号输入端分别连接所述DAC电容阵列的同相输入端和反相输入端，在实现了一阶残差存储后，同相二阶噪声整形电路和反相二阶噪声整形电路并联后的两端分别连接所述DAC电容阵列的同相输入端和反相输入端；在下一量化阶段，同相一阶噪声整形电路的信号输出端和反相一阶噪声整形电路的信号输出端分别连接所述比较器第二同相输入端和第二反相输入端；同相二阶噪声整形电路的信号输出端和反相二阶噪声整形电路的信号输出端分别连接所述比较器的第一同相输入端和第一反相输入端。

全文数据：

权利要求：

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