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申请/专利权人：长鑫存储技术有限公司
申请日：2020-08-26
公开（公告）日：2024-05-17
公开（公告）号：CN114115441B
主分类号：G06F1/12
分类号：G06F1/12;G06F13/12;G06F15/17
优先权：
专利状态码：有效-授权
法律状态：2024.05.17#授权;2022.03.18#实质审查的生效;2022.03.01#公开
摘要：本发明实施例提供一种存储器，包括：控制芯片；多个存储芯片，多个所述存储芯片共用信道与所述控制芯片电连接，多个所述存储芯片被配置为，采用相同的时钟信号，且多个所述存储芯片分别在所述时钟信号的不同的时钟状态下与所述控制芯片进行信息交互。本发明实施例能够减少存储器的信道数量。
主权项：1.一种存储器，其特征在于，包括：控制芯片；多个存储芯片，多个所述存储芯片共用信道与所述控制芯片电连接，多个所述存储芯片被配置为，采用相同的时钟信号，且多个所述存储芯片分别在所述时钟信号的不同的时钟状态下与所述控制芯片进行信息交互；所述多个存储芯片包括：第一存储芯片和第二存储芯片；所述第一存储芯片被配置为，在所述时钟信号的上升沿与所述控制芯片进行信息交互；所述第二存储芯片被配置为，在所述时钟信号的下降沿与所述控制芯片进行信息交互；所述时钟信号包括命令时钟和数据时钟，所述多个所述存储芯片分别在所述时钟信号的不同的时钟状态下与所述控制芯片进行信息交互，包括：所述第一存储芯片在所述命令时钟和或所述数据时钟的上升沿与所述控制芯片进行信息交互；所述第二存储芯片在所述命令时钟和或所述数据时钟的下降沿与所述控制芯片进行信息交互；每一所述存储芯片包括至少一个通道，所述通道包括：多个存储块，每一所述存储块包括多个存储单元，多个所述存储块被配置为交替进行读写操作；命令端口，所述命令端口被配置为在所述命令时钟的对应时钟沿接收命令信号，所述命令信号用于控制所述存储块的读写操作；数据端口，所述数据端口被配置为，在所述数据时钟的对应时钟沿接收待写入到所述存储块的数据信号或者发送数据信号；其中，所述对应时钟沿包括所述上升沿或者所述下降沿，所述命令端口包括行地址端口和列地址端口，所述行地址端口用于接收目标存储单元所在位置的行地址信号，所述列地址端口用于接收目标存储单元所在位置的列地址信号，所述目标存储单元为所述多个存储单元中选中的存储单元。
全文数据：
权利要求：
百度查询： 长鑫存储技术有限公司 存储器
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