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【发明授权】一种实现MAC层对接的RGMII接口的延时电路及延时方法_广州芯德通信科技股份有限公司_202111456121.3 

申请/专利权人:广州芯德通信科技股份有限公司

申请日:2021-12-01

公开(公告)日:2022-10-18

公开(公告)号:CN114244324B

主分类号:H03K5/13

分类号:H03K5/13

优先权:

专利状态码:有效-授权

法律状态:2022.10.18#授权;2022.04.12#实质审查的生效;2022.03.25#公开

摘要:本发明公开了一种实现MAC层对接的RGMII接口的延时电路及延时方法,其中延时电路包括第一级延时电路、第二级延时电路、时钟信号输入端、时钟信号输出端;所述的时钟信号输入端用于输入第一时钟信号;所述的第一级延时电路的输入端与时钟信号输入端电连接;所述的第一级延时电路的输出端与第二级RC延时电路的输入端电连接,组成联级延时电路;所述的第二级RC延时电路的输出端与时钟信号输出端电连接;所述的时钟信号输出端用于输出第二时钟信号。本发明不依赖软件进行信号延时调节,实现MAC层芯片与MAC层芯片互连,无需通过外部PHY芯片进行转换,且电路简单不大量增加元器件,不占用PCB空间,对成本控制效果佳。

主权项:1.一种实现MAC层对接的RGMII接口的延时电路,其特征在于:包括第一级延时电路A、第二级延时电路B、时钟信号输入端CLKIN、时钟信号输出端CLKOUT;所述的时钟信号输入端CLKIN用于输入第一时钟信号;所述的第一级延时电路A的输入端与时钟信号输入端CLKIN电连接;所述的第一级延时电路A的输出端与第二级RC延时电路的输入端电连接,组成联级延时电路;所述的第二级RC延时电路的输出端与时钟信号输出端CLKOUT电连接;所述的时钟信号输出端CLKOUT用于输出第二时钟信号;所述的第一级延时电路A包括第一RC延时电路、第一幅值补偿电路、第一运算放大器U1;所述的第一RC延时电路的输入端与时钟信号输入端CLKIN电连接;所述的第一RC延时电路的输出端与第一运算放大器U1的正输入端电连接;所述的第一幅值补偿电路的输入端与时钟信号输入端CLKIN电连接;所述的第一幅值补偿电路的输出端与第一运算放大器U1的负输入端电连接;所述的第一运算放大器U1的输出端与第二级RC延时电路的输入端电连接;所述的第二级延时电路B包括第二RC延时电路、第二幅值补偿电路、第二运算放大器U2;所述的第二RC延时电路的输入端与所述的第一运算放大器U1的输出端电连接;所述的第二RC延时电路的输出端与第二运算放大器U2的正输入端电连接;所述的第二幅值补偿电路的输入端与时钟信号输入端CLKIN电连接;所述的第二幅值补偿电路的输出端与第二运算放大器U2的负输入端电连接;所述的第二运算放大器U2的输出端与时钟信号输出端CLKOUT电连接,用于输出第二时钟信号;利用第一级延时电路A、第二级RC延时电路组成联级延时电路;通过两级延时电路进行两次延时调节,并通过对时钟输入信号进行两次补偿,使输出第二时钟信号的幅度等于输入第一时钟信号的幅度;所述的第一RC延时电路包括第一电阻R1、第二电阻R2、第一电容C1、第二电容C2;所述的第一电阻R1与第二电阻R2并联连接,并联后的一端与时钟信号输入端CLKIN电连接,并联后的一端与第一运算放大器U1的正输入端电连接;所述的第一电容C1、第二电容C2并联连接,并联后的一端接地,并联后的一端与第一运算放大器U1的正输入端电连接;所述的第一幅值补偿电路包括第三电阻R3、第四电阻R4、第五电阻R5;所述的第三电阻R3、第四电阻R4并联连接,并联后的一端与时钟信号输入端CLKIN电连接,并联后的一端与第一运算放大器U1的负输入端电连接;所述的第五电阻R5的一端与第一运算放大器U1的负输入端电连接;所述的第五电阻R5的另一端与第一运算放大器U1的输出端电连接;所述的第二RC延时电路包括第六电阻R6、第三电容C3;所述的第六电阻R6的一端与第一运算放大器U1的输出端电连接;所述的第六电阻R6的另一端与第二运算放大器U2的正输入端电连接;所述的第三电容C3的一端与第二运算放大器U2的正输入端电连接;所述的第三电容C3的另一端接地;所述的第二幅值补偿电路包括第七电阻R7、第八电阻R8;所述的第七电阻R7的一端与时钟信号输入端CLKIN电连接;所述的第七电阻R7的另一端与第二运算放大器U2的负输入端电连接;所述的第八电阻R8的一端接在所述的第七电阻R7的另一端与第二运算放大器U2的负输入端之间;所述的第八电阻R8的另一端与第二运算放大器U2的输出端与时钟信号输出端CLKOUT之间;通过调节第一电阻R1、第二电阻R2的电阻值,使其S信号点输出时钟滞后于输入的第一时钟信号,实现第一级延时;通过调整第三电阻R3、第四电阻R4、第五电阻R5,以恢复输出信号U0幅值;通过调整第六电阻R6进行第二级延时,通过调整第七电阻R7、第八电阻R8,以恢复输出时钟信号幅值;使输出的第二时钟信号的幅度等于输入的第一时钟信号的幅度。

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