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【发明公布】读取等待时间计数器延迟反馈方法、延迟反馈存储结构_浙江力积存储科技有限公司_202310423019.6 

申请/专利权人:浙江力积存储科技有限公司

申请日:2023-04-20

公开(公告)日:2023-05-23

公开(公告)号:CN116153362A

主分类号:G11C11/408

分类号:G11C11/408

优先权:

专利状态码:有效-授权

法律状态:2023.08.25#授权;2023.06.09#实质审查的生效;2023.05.23#公开

摘要:本发明公开了一种读取等待时间计数器延迟反馈方法和据此方法的延迟反馈存储结构,该方法和结构用于实现指令缓存器输入指针和输出指针之间延迟时间的反馈,所述方法包括:配置一编码电路的步骤,该编码电路被配置为:由输出时钟信号触发循环计数,包含多路输出,以及,通过编码电路的各路输出将输出指针编码后输出;对编码电路的各路输出分别按照延迟时间进行延迟的步骤;配置至少一路译码电路的步骤,该译码电路被配置为:将所述编码电路经延迟后的各路输出按照预设顺次组合以形成所述输入指针,根据此方法和结构,能够减少输入输出指针间延迟线数量,节省芯片版图设计面积,优化读取等待时间计数器实现方法。

主权项:1.一种读取等待时间计数器延迟反馈方法,该方法用于实现指令缓存器输入指针和输出指针之间延迟时间的反馈,其中,所述延迟反馈方法包括如下步骤:配置一编码电路的步骤,该编码电路被配置为:由输出时钟信号触发循环计数,包含多路输出,以及,通过所述编码电路的各路输出将所述输出指针编码后输出;对所述编码电路的各路输出分别按照所述延迟时间进行延迟的步骤;配置至少一路译码电路的步骤,该译码电路被配置为:将所述编码电路经延迟后的各路输出按照预设顺次组合以形成所述输入指针。

全文数据:

权利要求:

百度查询: 浙江力积存储科技有限公司 读取等待时间计数器延迟反馈方法、延迟反馈存储结构

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