申请/专利权人：深圳市奇普乐芯片技术有限公司;上海奇普乐芯片科技有限公司

申请日：2023-11-29

公开（公告）日：2024-03-19

公开（公告）号：CN117725001A

主分类号：G06F13/14

分类号：G06F13/14

优先权：

专利状态码：在审-实质审查的生效

法律状态：2024.04.05#实质审查的生效;2024.03.19#公开

摘要：本发明涉及芯片技术领域，公开了一种芯片互连系统、计算机设备及数据处理方法，芯片互连系统包括多个功能芯片和交换芯片；交换芯片用于对功能芯片之间的数据包进行交换；交换芯片包括互连交换模块，交换芯片通过互连交换模块从功能芯片接收数据包，并通过互连交换模块向另一个功能芯片发送数据包，互连交换模块包括多个路由节点，路由节点与多个功能芯片中的至少一个功能芯片连接；交换芯片还包括监控模块，监控模块包括拥塞检测单元和拥塞控制单元；拥塞检测单元用于获取路由路径的拥塞参数和通信数据误差率并发送至拥塞控制单元；拥塞控制单元用于根据拥塞参数和通信数据误差率控制数据包的目标路由路径的选择。本发明能够提升数据传输效率。

主权项：1.一种芯片互连系统，其特征在于，所述芯片互连系统包括多个功能芯片和交换芯片；所述交换芯片用于对所述功能芯片之间的数据包进行交换；所述交换芯片包括互连交换模块，所述交换芯片通过所述互连交换模块从所述功能芯片接收数据包，并通过所述互连交换模块向另一个功能芯片发送所述数据包，其中，所述互连交换模块包括多个路由节点，所述路由节点与所述多个功能芯片中的至少一个功能芯片连接；所述交换芯片还包括监控模块，所述监控模块包括拥塞检测单元和拥塞控制单元；所述拥塞检测单元用于获取路由路径的拥塞参数和通信数据误差率并发送至所述拥塞控制单元，其中，所述拥塞参数用于表征所述数据包通过的路由路径的拥塞程度，所述通信数据误差率用于表征传输所述数据包的准确性；所述拥塞控制单元用于根据所述拥塞参数和所述通信数据误差率控制所述数据包的目标路由路径的选择。

全文数据：

权利要求：

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