申请/专利权人：合芯科技(苏州)有限公司;合芯科技有限公司

申请日：2023-07-25

公开（公告）日：2024-03-19

公开（公告）号：CN116959518B

主分类号：G11C7/22

分类号：G11C7/22;G11C11/413

优先权：

专利状态码：有效-授权

法律状态：2024.03.19#授权;2023.11.14#实质审查的生效;2023.10.27#公开

摘要：本申请提供了一种自定时电路与静态随机存取存储器，涉及半导体技术领域，该自定时电路包括内部时钟生成模块与内部控制信号生成模块，其中，内部时钟生成模块包括控制单元与时钟生成单元，控制单元包括反馈回路；该反馈回路被配置为接收外部时钟信号、第一反馈信号、第二反馈信号以及读写控制信号，并基于接收到的上述各信号，输出控制信号；时钟生成单元被配置为基于上述控制信号生成内部时钟信号；内部控制信号生成模块被配置为基于上述内部时钟信号，生成内部控制信号；其中，上述第一反馈信号为上述内部控制信号，上述第二反馈信号为上述控制信号。本申请能够提升自定时电路生成内部时钟信号的速度。

主权项：1.一种自定时电路，其特征在于，包括：内部时钟生成模块与内部控制信号生成模块，其中，所述内部时钟生成模块包括控制单元与时钟生成单元，所述控制单元包括反馈回路；所述反馈回路被配置为接收外部时钟信号、第一反馈信号、第二反馈信号以及读写控制信号，并基于接收到的所述外部时钟信号、所述第一反馈信号、所述第二反馈信号以及所述读写控制信号，输出控制信号；所述时钟生成单元被配置为基于所述控制信号生成内部时钟信号；所述内部控制信号生成模块被配置为基于所述内部时钟信号，生成内部控制信号；其中，所述第一反馈信号为所述内部控制信号，所述第二反馈信号为所述控制信号；所述反馈回路包括多个逻辑门；所述多个逻辑门包括第一或非门、第一与非门以及第二与非门；其中：所述第一或非门的一个输入端用于接收所述内部控制信号，所述第一或非门的另一个输入端用于接收所述第二反馈信号，所述第一或非门的输出端与所述第一与非门的一个输入端连接；所述第一与非门的另一个输入端用于接收所述外部时钟信号，所述第一与非门的输出端与所述第二与非门的一个输入端连接；所述第二与非门的另一个输入端用于接收所述读写控制信号，所述第二与非门的输出端用于输出所述控制信号。

全文数据：

权利要求：

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