申请/专利权人：中国计量大学

申请日：2023-07-17

公开（公告）日：2024-03-29

公开（公告）号：CN117789790A

主分类号：G11C13/00

分类号：G11C13/00;H03K17/687

优先权：

专利状态码：在审-实质审查的生效

法律状态：2024.04.16#实质审查的生效;2024.03.29#公开

摘要：本发明公开了一种基于VDTA‑VDCA的完全浮动型忆阻器模拟电路。整体电路由1个VDTA、1个VDCA、一个电容C、两个PMOS晶体管MR1、MR2构成。其中，MR1和MR2构成忆阻器电路的可变电阻器；VDTA控制MR1和MR2的栅极电压，改变MR1和MR2上流过的电流；VDCA产生开关控制信号，实现忆阻器电路的长时间记忆功能。设计的忆阻器电路兼容CMOS工艺，利于电路集成，具有长时间保持的特性和完全浮动的特点，并且无需改变电路的拓扑结构就可以实现忆阻器递增、递减模式之间的切换。

主权项：1.一种基于VDTA-VDCA的完全浮动型忆阻器模拟电路，电路特点在于：整体电路由1个VDTA、1个VDCA、1个电容C、2个PMOS晶体管MR1、MR2构成。其中，MR1的栅极和MR2的栅极连接，MR1的源极和MR2的漏极连接，MR1的漏极和MR2的源极连接，MR1和MR2构成忆阻器电路的可变电阻器；VDTA-VDCA由VDTA和VDCA两个电路模块构成，具体包括2个电流传送器、1个互补电压放大器、1个开关电路和1个共用的差分放大器；差分放大器的P端口和N端口均可作为忆阻器电路的输入、输出端口，差分放大器的跨导增益由B端口的输入电压VB控制；开关电路的开启或关闭由输入Z端口的高低电平控制，W端口为开关电路的输出端口；X端口为互补电压放大器的输出端口；VDTA和VDCA共用1个差分放大器，VDTA控制MR1和MR2的栅极电压，改变MR1和MR2上流过的电流，VDCA产生开关电路的控制信号，实现忆阻器电路的长时间记忆功能。当给忆阻器电路通入偏置电压VDD、VSS和VB，并在P端口和N端口输入电压信号时，差分放大器将放大后的电压信号分别传输至互补电压放大器和电流传送器，电压信号的放大倍数由电路的偏置电压VB决定；放大后的电压信号经过互补电压放大器，产生的控制信号从X端口输出；X端口和开关电路中的Z端口连接，当开关电路的Z端口输入低电平时，开关电路开启，电流传送器上产生的电流流入电容C，电容C上的电压控制MR1和MR2上流过的电流，当输入高电平时，开关电路关闭，电容C上的电荷得到保存，电容C上的电压不变。忆阻器电路的阻值等效为忆阻器电路的输入电压与MR1和MR2上流过的电流之间的比值。当忆阻器电路的P端口作为输入端口，N端口作为输出端口时，忆阻器电路工作在阻值递增状态，当忆阻器电路的N端口作为输入端口，P端口作为输出端口时，忆阻器电路工作在阻值递减状态。设计的忆阻器电路兼容CMOS工艺，利于电路集成，具有长时间保持的特性和完全浮动的特点，并且无需改变电路的拓扑结构就可以实现忆阻器递增、递减模式之间的切换。

全文数据：

权利要求：

百度查询： 中国计量大学 一种基于VDTA-VDCA的完全浮动型忆阻器模拟电路

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