申请/专利权人：铠侠股份有限公司

申请日：2022-03-10

公开（公告）日：2022-09-20

公开（公告）号：CN115080461A

主分类号：G06F12/1009

分类号：G06F12/1009;G06F12/0897

优先权：["20210312 US 17/200,149"]

专利状态码：在审-实质审查的生效

法律状态：2024.03.26#实质审查的生效;2022.09.20#公开

摘要：一种由控制器执行的方法包括：将第一状态指示符指派给属于存储于非易失性存储器中的LUT的第一区的易失性存储器中的第一地址线中的条目且将第二状态指示符指派给属于所述LUT的第二区的所述易失性存储器中的所述第一地址线中的条目；基于所述易失性存储器中的地址m处的高速缓存更新条目是属于所述LUT的所述第一区还是所述第二区来将所述第一或第二状态指示符设置为脏状态；及基于所述地址m处的所述第一及第二状态指示符的所述脏状态来将与含有所述更新条目的所述第一区或所述第二区相关联的所述易失性存储器中的所有条目写入到所述非易失性存储器。

主权项：1.一种存储器存储系统，其包括：非易失性半导体存储器装置，其经配置以存储包括分组到至少一个第一区及至少一个第二区中的条目的查找表LUT；易失性半导体存储器装置，其经配置以临时存储来自所述非易失性半导体存储器装置的所述LUT的所述条目；及控制器，其经配置以响应于从在所述存储器存储系统外部的主机接收的命令而存储及检索所述非易失性半导体存储器装置中的数据，所述控制器包括高速缓存，所述高速缓存包括通信地耦合到所述易失性半导体存储器装置的多个高速缓存线且经配置以将从所述易失性半导体装置的多个地址中的地址m读取的条目临时存储于所述多个高速缓存线中的高速缓存线z中，所述控制器经配置以：将第一状态指示符及第二状态指示符指派给对应于所述易失性半导体存储器装置的多个高速缓存地址的所述高速缓存中的所述多个高速缓存线中的每一者，所述第一状态指示符对应于属于所述LUT的所述第一区的所述易失性半导体存储器装置的第一高速缓存地址的条目，且所述第二状态指示符对应于属于所述LUT的所述第二区的所述易失性半导体存储器装置的所述第一高速缓存地址的条目，更新读取到所述高速缓存的所述高速缓存线z中的所述易失性半导体存储器装置中的所述地址m处的所述LUT的条目，基于从所述地址m读取的所述高速缓存线z中的经更新条目是在所述LUT的相应所述第一区还是所述第二区中来将所述第一状态指示符或所述第二状态指示符设置为脏状态，及基于所述高速缓存线z的所述第一状态指示符或所述第二状态指示符的所述脏状态来将与含有所述经更新条目的所述第一区或所述第二区相关联的所述易失性半导体存储器装置中的所有条目复制到所述非易失性半导体存储器装置。

全文数据：

权利要求：

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