申请/专利权人：北京地平线信息技术有限公司

申请日：2024-01-12

公开（公告）日：2024-04-12

公开（公告）号：CN117877547A

主分类号：G11C8/10

分类号：G11C8/10;G11C8/06;G11C8/18

优先权：

专利状态码：在审-实质审查的生效

法律状态：2024.04.30#实质审查的生效;2024.04.12#公开

摘要：公开了一种实现冗余存算功能的存算一体电路及存算一体芯片，该电路包括：多个基础存算单元；冗余存算单元；主控制器，用于获取操作指令；地址比对模块，用于获取及存储失效的基础存算单元的单元地址信息，将操作指令指向的待访问地址信息与单元地址信息进行比对，得到地址比对结果信号；时钟控制模块，用于从冗余存算单元以及与待访问地址信息对应的基础存算单元中，确定与地址比对结果信号适配的目标存算单元，向目标存算单元传输第一时钟信号，以使目标存算单元置于可操作状态；执行模块，用于在目标存算单元的可操作状态下，基于主控制器的控制，针对目标存算单元执行操作指令对应的操作。本公开有利于保证存算一体芯片的正常可靠工作。

主权项：1.一种实现冗余存算功能的存算一体电路，包括：多个基础存算单元；冗余存算单元；主控制器，所述主控制器用于获取操作指令；地址比对模块，所述地址比对模块用于获取及存储失效的所述基础存算单元的单元地址信息，所述地址比对模块还用于获取所述操作指令指向的待访问地址信息，将所述待访问地址信息与所述单元地址信息进行比对，得到地址比对结果信号；时钟控制模块，所述时钟控制模块用于从所述冗余存算单元以及与所述待访问地址信息对应的所述基础存算单元中，确定与所述地址比对结果信号适配的目标存算单元，以及向所述目标存算单元传输第一时钟信号；其中，所述第一时钟信号用于使所述目标存算单元置于可操作状态；执行模块，所述执行模块用于在所述目标存算单元的可操作状态下，基于所述主控制器的控制，针对所述目标存算单元执行所述操作指令对应的操作。

全文数据：

权利要求：

百度查询： 北京地平线信息技术有限公司 实现冗余存算功能的存算一体电路及存算一体芯片

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