申请/专利权人:深圳市一博科技股份有限公司
申请日:2023-07-17
公开(公告)日:2024-03-22
公开(公告)号:CN220653602U
主分类号:H05K1/02
分类号:H05K1/02;H05K1/18
优先权:
专利状态码:有效-授权
法律状态:2024.03.22#授权
摘要:本实用新型公开了一种主干阻抗分段控制的DDRX互连等臂分支拓扑结构,包括主芯片,所述主芯片连接有主干走线,所述主干走线连接有至少两条分支走线,每条所述分支走线连接有一个负载芯片,所述主干走线分为第一主干走线段和第二主干走线段,所述第一主干走线段靠近所述主芯片,所述第二主干走线段靠近所述分支走线,所述第二主干走线段、所述分支走线的特征阻抗相同,所述第一主干走线段的特征阻抗小于所述第二主干走线段的特征阻抗。本实用新型通过对等臂分支拓扑主干部分走线的特征阻抗进行分段控制,提高了信号完整性,达到改善信号质量的目的。
主权项:1.一种主干阻抗分段控制的DDRX互连等臂分支拓扑结构,包括主芯片,所述主芯片连接有主干走线,所述主干走线连接有至少两条分支走线,每条所述分支走线连接有一个负载芯片,其特征在于,所述主干走线分为第一主干走线段和第二主干走线段,所述第一主干走线段靠近所述主芯片,所述第二主干走线段靠近所述分支走线,所述第二主干走线段、所述分支走线的特征阻抗相同,所述第一主干走线段的特征阻抗小于所述第二主干走线段的特征阻抗。
全文数据:
权利要求:
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